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求助Verilog程序設(shè)計(jì)(有償),高手速進(jìn)來!!! |
| 作者：herozoujie 欄目：IC設(shè)計(jì) |
我現(xiàn)在有一個(gè)結(jié)構(gòu)需要實(shí)現(xiàn),如果您有相關(guān)的Verilog設(shè)計(jì)經(jīng)驗(yàn),請馬上與我聯(lián)系 tel:13122658787 Email:cgperson@163.net |
| 2樓： | >>參與討論 |
| 作者： rockonnow 于 2006/9/29 15:24:00 發(fā)布：
jessetek@163.com,請說一下規(guī)格！ |
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| 3樓： | >>參與討論 |
| 作者： wwwwggggqqqq 于 2006/9/29 16:07:00 發(fā)布：
搞得挺神秘的哈 |
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| 4樓： | >>參與討論 |
| 作者： laoyzyue 于 2006/9/30 10:12:00 發(fā)布：
yzyue@sina.com |
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| 5樓： | >>參與討論 |
| 作者： fq_moon 于 2006/10/5 19:59:00 發(fā)布：
應(yīng)把結(jié)構(gòu)圖實(shí)現(xiàn)的功能列出來！大家好考慮 |
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