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d芯片,它是一種采樣速率最高可達(dá)1msps,分辨率為12bit的采集芯片,多達(dá)8個通道的同時采樣,+5v模擬電源,+3v至+5v數(shù)字電源,其硬件系統(tǒng)連接如圖2所示: 圖2 max1308ad硬件連接 2.2 fifo存儲電路 fifo電路芯片選用idt公司的idt7203,它是一個雙端口的存儲緩沖芯片,有2048×9 的存儲結(jié)構(gòu),12ns 的高速存取時間,結(jié)構(gòu)簡單便于操作,內(nèi)部讀、寫指針在先進(jìn)先出的基礎(chǔ)上可進(jìn)行數(shù)據(jù)的自動寫入和讀出。 2.3 cpld控制電路設(shè)計 cpld(epm7160stc100-6)的設(shè)計是本采集系統(tǒng)的核心,它能夠?qū)c104地址總線進(jìn)行譯碼,所產(chǎn)生的邏輯控制信號對各個單元的工作狀態(tài)起控制作用。 數(shù)據(jù)的讀取可以采用查詢的方式。在pc104 isa部分,用到isa的16位數(shù)據(jù)總線d[0..15]。a[0..9]是pc104的地址總線;iow和ior是對指定設(shè)備的讀寫信號;aen是允許dma控制地址總線、數(shù)據(jù)總線及讀寫命令線進(jìn)行dma傳輸及對存儲器和io設(shè)備的讀寫。系統(tǒng)工作流程如圖3所示: 圖3 系統(tǒng)工作流程 數(shù)據(jù)采集系統(tǒng)的工作邏輯框圖如圖4所示: 圖4
EPM7192 EPM7256 EPM7256AE EPM7256AETC100 EPM7256AETC100-10 EPM7256AETC100-10T EPM7256AETC100-5 EPM7256AETC144-5 EPM7256AETI144-7 EPM7256EQC160-20
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