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求助:使用MAX+PLUSII編譯VHDL程序出現(xiàn)的問(wèn)題

作者:珊瑚蟲(chóng) 欄目:EDA技術(shù)
求助:使用MAX+PLUSII編譯VHDL程序出現(xiàn)的問(wèn)題

使用MAX+PLUSII baseline10.1,
在編譯過(guò)程中(大概才完成50%)老出現(xiàn)下面的錯(cuò)誤:
   Internal Error:(ge_)DDF Error:Can't open file C:\Program Files\
maxplus2\t2880240.ddf
Please contact ALTERA Applications at 1 (800) 800-EPLD or......
請(qǐng)問(wèn)這是什么問(wèn)題?該如何解決?
謝謝

2樓: >>參與討論
珊瑚蟲(chóng)
重新安裝后,還是有問(wèn)題

哪位朋友幫幫忙,謝謝啦

3樓: >>參與討論
珊瑚蟲(chóng)
我的程序如下
-- MAX+plus II VHDL Template
-- Clearable loadable enablable counter

LIBRARY ieee;
USE ieee.std_logic_1164.all;

--定義實(shí)體
ENTITY counter12 IS

    PORT
    (
        clk        : IN    STD_LOGIC;
        clear   : IN    STD_LOGIC;
        en        : IN    STD_LOGIC;
        q        : OUT     INTEGER RANGE 0 TO 11;
        cout    : OUT     STD_LOGIC
    );
    
END counter12;

--結(jié)構(gòu)體部分
ARCHITECTURE a OF counter12 IS

    SIGNAL    q_signal    : INTEGER RANGE 0 TO 11;
    
BEGIN

    PROCESS (clk, clear)
    BEGIN
        --判斷是否清零
        IF clear = '0' THEN        
            q_signal <= 0;
        --否則,在時(shí)鐘的上升沿進(jìn)行計(jì)數(shù)操作    
        ELSIF (clk'EVENT AND clk = '1') THEN
                if    en = '1' THEN
                --判斷當(dāng)前計(jì)數(shù)是否到達(dá)頂點(diǎn),如果是,則計(jì)數(shù)器清零,同時(shí)輸出進(jìn)位信號(hào)
                if q_signal = 11 then    
                      q_signal <= 0;
                   cout <= '1';
                --否則,計(jì)數(shù)器加一,進(jìn)位輸出無(wú)?    
            ELSE
                q_signal <= q_signal + 1;
                cout <= '0';
            END IF;
        ELSE
            q_signal <= q_signal;                    
        END IF;
            
    END IF;
        
    END PROCESS;

    q <= q_signal;
    
END a;

4樓: >>參與討論
sasinop
頂下 沒(méi)遇到 幫你問(wèn)問(wèn) 周一
 
5樓: >>參與討論
珊瑚蟲(chóng)
謝先

謝先
可能是程序的問(wèn)題
因?yàn)槲业牧硪粋(gè)程序可以編譯的,呵呵

6樓: >>參與討論
xiao
呵呵,我編譯你的程序沒(méi)問(wèn)題呀。我用的版本是10.23
 
7樓: >>參與討論
珊瑚蟲(chóng)
re
謝謝
在我自己的機(jī)子上也能編譯通過(guò)了,我用的是baseline10.2
奇怪

參與討論
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