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關于上電復位電路(power on reset) |
| 作者：wengong 欄目：IC設計 |
請教一下: POWER on reset CIRCUIT 的輸出應該是什么樣的波形? 我看了幾篇論文,上面給出的波形是當v(supply)大于一定的值后,輸出是高電平,然后又跳回低電平(這時電源是5v) 為什么??? 在電源電壓穩(wěn)定為高的情況下輸出不是一直會保持高電平? |
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| 作者： boris 于 2005/4/12 0:20:00 發(fā)布：
電源電壓穩(wěn)定時，輸出需要保持固定電平 對于高電平復位的上電復位電路來說，當電源電壓由0V上升到一定幅度后，就輸出高電平，表示進行復位。經(jīng)過一段時間后，輸出自動變?yōu)榈碗娖剑硎緩臀唤Y束，進入正常工作狀態(tài)。 如果電源電壓穩(wěn)定，則上電復位電路必須保持低電平，否則就會對其它電路進行復位操作，這就不是上電時的復位了。只有在電源電壓跌落后又上升到足夠幅度時，上電復位電路才能輸出高電平以表示進行復位。 對于低電平復位的上電復位電路來說，要求一樣，只是輸出高、低電平與上面剛好相反。 |
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| 作者： wengong 于 2005/4/12 14:45:00 發(fā)布：
re 謝謝,幫了我很大的忙! |
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| 作者： incol 于 2005/4/14 10:12:00 發(fā)布：
但是有的論文上說的不一樣 有的論文說當supply上升到一定電壓后，延遲一段時間，如果supply一直在這個電壓之上，那么OUTPUT變?yōu)楦唠娖�，并且一直維持高電平。當supply有一個地電平脈沖，OUTPUT馬上變?yōu)榈仉娖�，并且在supply變回高電平之后延遲一段時間，即supply穩(wěn)定以后，OUTPUT變回高電平 |
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| 作者： boris 于 2005/4/14 19:54:00 發(fā)布：
to incol 你說的是低電平復位的情況，與我的描述是一致的。 |
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| 作者： incol 于 2005/4/15 12:01:00 發(fā)布：
不對啊，和你的一樣， 我的也是電源電壓上升到一定幅度后，輸出高電平，只是高電平一直保持著，你的是高電平只保持一段時間（一個脈沖） |
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| 7樓： | >>參與討論 |
| 作者： boris 于 2005/4/16 22:39:00 發(fā)布：
那我把低電平復位的情況再描述一遍吧 對于低電平復位的上電復位電路來說，當電源電壓由0V上升到一定幅度后，就輸出低電平，表示進行復位（在電源電壓上升到這個幅度之前，上電復位電路一般會輸出高電平，即電源電壓。但如果輸出低電平，也不算功能錯誤）。經(jīng)過一段時間后，輸出自動變?yōu)楦唠娖�，表示復位結束，進入正常工作狀態(tài)。 如果電源電壓穩(wěn)定，則上電復位電路必須保持高電平，否則就會對其它電路進行復位操作，這就不是上電時的復位了。只有在電源電壓跌落后又上升到足夠幅度時，上電復位電路才能輸出一段時間的低電平以表示進行復位。 |
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| 8樓： | >>參與討論 |
| 作者： 一粒塵 于 2005/6/6 0:37:00 發(fā)布：
如果能有個圖，那就更了。。。。 |
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