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求教verilog |
| 作者：ljyoicq 欄目：EDA技術(shù) |
為什么我在編譯一些文件時總會在最后幾行出現(xiàn)我沒打過的字符？ 導(dǎo)致編譯無法通過？ 這是軟件的bug么？ |
| 2樓： | >>參與討論 |
| 作者： liyun022 于 2005/4/11 20:17:00 發(fā)布：
中文輸入 有可能是你是在中文輸入法的狀態(tài)下輸入源文件的,這樣你打的空格就會成為亂碼! |
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