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AS7C4098A Datasheet

  • AS7C4098A

  • 2.5V 512K x 32/36 flowthrough burst synchronous SRAM

  • 525.47KB

  • 19頁

  • ALSC

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December 2004
廬
AS7C25512FT32A
AS7C25512FT36A
2.5V 512K
脳
32/36 flowthrough burst synchronous SRAM
Features
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鈥?/div>
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Organization: 524,288 words 脳 32 or 36 bits
Fast clock to data access: 7.5/8.5/10.0 ns
Fast OE access time: 3.5/4.0 ns
Fully synchronous flow-through operation
Asynchronous output enable control
Available in 100-pin TQFP package
Individual byte write and global write
Multiple chip enables for easy expansion
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鈥?/div>
鈥?/div>
2.5V core power supply
Linear or interleaved burst control
Snooze mode for reduced power-standby
Common data inputs and data outputs
Logic block diagram
LBO
CLK
ADV
ADSC
ADSP
A[18:0]
19
CLK
CE
CLR
D
CE
Address
register
CLK
D
Q0
Burst logic
Q1
19
Q
17
19
512K 脳 32/36
Memory
array
GWE
BWE
BW
d
DQ
d
Q
Byte write
registers
CLK
D
DQ
c
Q
Byte write
registers
CLK
D
DQ
b
Q
Byte write
registers
CLK
DQ
a
Q
Byte write
registers
CLK
D
Enable
CE
register
CLK
Power
down
D
Enable
Q
delay
register
CLK
Q
D
36/32
36/32
BW
c
BW
b
BW
a
CE0
CE1
CE2
4
OE
Output
buffer
Input
registers
CLK
ZZ
OE
36/32
DQ[a:d]
Selection guide
Minimum cycle time
Maximum clock access time
Maximum operating current
Maximum standby current
Maximum CMOS standby current (DC)
-75
8.5
7.5
275
90
60
-85
10
8.5
250
80
60
-10
12
10
230
80
60
Units
ns
ns
mA
mA
mA
12/23/04, v. 1.2
Alliance Semiconductor
1 of 19
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