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歷史最低報(bào)價(jià):¥0.0000 歷史最高報(bào)價(jià):¥0.0000 歷史平均報(bào)價(jià):¥0.0000
l:半字節(jié)定義選擇,與hpic寄存器中的hwob位進(jìn)行配合可以選擇當(dāng)前傳輸?shù)氖歉甙胱诌€是低半字。低電平是第一個(gè)半字,高電平是第二個(gè)半字。 hcs:選通脈沖(strobe),與hds1、hds2相互配合完成內(nèi)部信號(hào)hstrobe的生成。邏輯關(guān)系如圖2所示。 將hds1、hds2分別固定為高電平和低電平,這樣hcs就和hstrobe完全一致。 hstrobe讀時(shí)序如圖3所示。 3.2 接口電路 arm處理器通過(guò)dsp的hpi接口與dsp進(jìn)行連接的硬件原理如圖4所示(以單板dsp為例)。其中sn74lvth16245為16位(二個(gè)8位)雙向三態(tài)總線收發(fā)器,主要起總線驅(qū)動(dòng)和方向控制的作用同時(shí)也保證在不對(duì)hpi口進(jìn)行操作時(shí)數(shù)據(jù)總線鎖閉。at91rm9200為atmel公司生產(chǎn)的arm9為核心的處理器,其中引腳d0-d15為數(shù)據(jù)總線,a2-a8為地址總線的一部分,cs3為片選信號(hào)線,當(dāng)arm對(duì)總線地址范圍為0x40000 0000~0x4fff ffff的外部設(shè)備進(jìn)行操作時(shí),會(huì)在該引腳產(chǎn)生一個(gè)片選信號(hào)。同時(shí)該信號(hào)控制sn74lvth16245的使能端,避免在讀寫其他地址時(shí)對(duì)hpi端口造成影響。tms320c671
程序下載到指定地址空間。實(shí)現(xiàn)系統(tǒng)bootloader的復(fù)位電路如圖2所示。時(shí)鐘電路的設(shè)計(jì)tms320vc33的時(shí)鐘,既可由外部提供,也可由板上的振蕩器來(lái)提供,但外部時(shí)鐘的精確度高、穩(wěn)定性好、使用方便,因而本設(shè)計(jì)中使用了12mhz的外部時(shí)鐘clkmd0 clkmd1=11的時(shí)鐘模式,經(jīng)內(nèi)部5倍頻后,產(chǎn)生60mhz 的系統(tǒng)時(shí)鐘??偩€驅(qū)動(dòng)由于dsp的地址總線和數(shù)據(jù)總線的驅(qū)動(dòng)能力有限,當(dāng)負(fù)載較大時(shí),需要用總線驅(qū)動(dòng)對(duì)其負(fù)載能力進(jìn)行擴(kuò)展,以保證系統(tǒng)能穩(wěn)定工作。本設(shè)計(jì)選用了ti公司的寬總線16位雙向總線驅(qū)動(dòng)器sn74lvth16245,它具有很高的集成度和性能。存儲(chǔ)子系統(tǒng)設(shè)計(jì)存儲(chǔ)器接口設(shè)計(jì)考慮的主要問(wèn)題是:如何采用ep2rom+高速ram的配置方式來(lái)實(shí)現(xiàn)存儲(chǔ)子系統(tǒng)。ep2rom用來(lái)存放測(cè)試系統(tǒng)的程序和初始化數(shù)據(jù),系統(tǒng)加電運(yùn)行時(shí),tms320vc33自動(dòng)將程序和初始化數(shù)據(jù)從低速ep2rom裝載到高速ram中。裝載完畢后,程序在高速ram中全速運(yùn)行。系統(tǒng)中存儲(chǔ)器裝載程序和初始化數(shù)據(jù)的ep2rom起始地址為400000h。同時(shí)系統(tǒng)中還擴(kuò)展了64k高速ram,起始地址為100000h。此外,片選信號(hào)由系統(tǒng)中cpld來(lái)實(shí)現(xiàn)。對(duì)于tms
個(gè)時(shí)鐘周期,以確保mcbsp在初始化過(guò)程中內(nèi)部能夠正確地同步。而后,配置max3110e的波特率和發(fā)送波形,發(fā)送數(shù)據(jù)時(shí)根據(jù)max3110e的數(shù)據(jù)手冊(cè)拼裝成一個(gè)16位的字進(jìn)行發(fā)送。接收通過(guò)dsp的int0中斷進(jìn)行處理。1.3 總線控制和驅(qū)動(dòng)本系統(tǒng)中總線有兩種:數(shù)據(jù)總線和地址總線。數(shù)據(jù)總線進(jìn)行數(shù)據(jù)交換,地址總線進(jìn)行尋址。因?yàn)閐sp的數(shù)據(jù)總線是3.3v的高電平邏輯值,可能出現(xiàn)不能驅(qū)動(dòng)外部5v的邏輯電平的情況;而且連接在動(dòng)能力不足。因此,需要對(duì)總線,特別是數(shù)據(jù)總線進(jìn)行加強(qiáng)驅(qū)動(dòng)能力的設(shè)計(jì)。其中數(shù)據(jù)總線使用sn74lvth16245來(lái)進(jìn)行驅(qū)動(dòng)向驅(qū)動(dòng);地址總線是單向的,沒(méi)有方向的控制,也沒(méi)有使能的控制,使用sn74lvth16244單向驅(qū)動(dòng)器就可以了。對(duì)于數(shù)據(jù)總線的控制,按照所邏輯合理使用了dsp_mstrb。dsp_iostrb、r/w就可以完成了。1.4 鍵盤與lcd接口的硬件設(shè)計(jì)鍵盤和lcd都是i/o器件,分配兩個(gè)i/o空間的地址,通過(guò)對(duì)地址的譯碼產(chǎn)生使能控制lcd和鍵盤。鍵盤上有12個(gè)按鍵,用10kω電阻拉高,同時(shí)使用與邏輯連接這12根線,輸出的邏輯電平接dsp中斷int2,在中斷服務(wù)程序中使用portr命令讀入鍵值
am29lv800bt內(nèi)部具有升壓電路,因此只需一個(gè)3.0v的電源即可完成在系統(tǒng)的編程與擦除操作。通過(guò)對(duì)其內(nèi)部的命令寄存器寫入符合jedec標(biāo)準(zhǔn)的命令序列,可對(duì)flash進(jìn)行編程(燒寫)、整片擦除、按扇區(qū)擦除以及其它操作。 2 ide接口電路設(shè)計(jì) 因?yàn)閍dsp-bf533的數(shù)據(jù)總線是3.3v的高電平邏輯值,可能出現(xiàn)不能驅(qū)動(dòng)外部sv的邏輯電平的情況,而且連接在數(shù)據(jù)總線的器件較多,也有可能使數(shù)據(jù)總線上的驅(qū)動(dòng)能力不足。因此,需要對(duì)總線,特別是數(shù)據(jù)總線進(jìn)行加強(qiáng)驅(qū)動(dòng)能力的設(shè)計(jì),這里數(shù)據(jù)總線使用sn74lvth16245來(lái)進(jìn)行雙向驅(qū)動(dòng)。sn74lvth 16245a的功能與74hc245類似,也是通過(guò)輸出使能(oe)和數(shù)據(jù)傳輸方向(dir)引腳來(lái)完成總線隔離與數(shù)據(jù)傳輸方向控制功能,不同的是,sn74lvth 16245a支持16位雙向傳輸,而74hc245支持8位。 ide接口是一種任務(wù)寄存器結(jié)構(gòu)的接口,主機(jī)通過(guò)訪問(wèn)端口寄存器來(lái)讀寫硬盤。ide寄存器可分為兩組:控制寄存器組和命令寄存器組。在ide與adsp-bf533的接口電路中,片選信號(hào)ter0、ter1和74hc245的oe連接到cpld,由cpld
初始化過(guò)程中內(nèi)部能夠正確地同步。 而后,配置max3110e的波特率和發(fā)送波形,發(fā)送數(shù)據(jù)時(shí)根據(jù)max3110e的數(shù)據(jù)手冊(cè)拼裝成一個(gè)16位的字進(jìn)行發(fā)送。接收通過(guò)dsp的int0中斷進(jìn)行處理。 1.3 總線控制和驅(qū)動(dòng) 本系統(tǒng)中總線有兩種:數(shù)據(jù)總線和地址總線。數(shù)據(jù)總線進(jìn)行數(shù)據(jù)交換,地址總線進(jìn)行尋址。因?yàn)閐sp的數(shù)據(jù)總線是3.3v的高電平邏輯值,可能出現(xiàn)不能驅(qū)動(dòng)外部5v的邏輯電平的情況;而且連接在動(dòng)能力不足。因此,需要對(duì)總線,特別是數(shù)據(jù)總線進(jìn)行加強(qiáng)驅(qū)動(dòng)能力的設(shè)計(jì)。其中數(shù)據(jù)總線使用sn74lvth16245來(lái)進(jìn)行驅(qū)動(dòng)向驅(qū)動(dòng);地址總線是單向的,沒(méi)有方向的控制,也沒(méi)有使能的控制,使用sn74lvth16244單向驅(qū)動(dòng)器就可以了。對(duì)于數(shù)據(jù)總線的控制,按照所邏輯合理使用了dsp_mstrb。dsp_iostrb、r/w就可以完成了。 1.4 鍵盤與lcd接口的硬件設(shè)計(jì) 鍵盤和lcd都是i/o器件,分配兩個(gè)i/o空間的地址,通過(guò)對(duì)地址的譯碼產(chǎn)生使能控制lcd和鍵盤。鍵盤上有12個(gè)按鍵,用10kω電阻拉高,同時(shí)使用與邏輯連接這12根線,輸出的邏輯電平接dsp中斷int2,在中斷服務(wù)程序中使用po
SN74LVTH16245A SN74LVTH18512DGGR SN74LVTH240DW SN74LVTH240DWR SN74LVTH244ADBR SN74LVTH245 SN74LVTH245A SN74LVTH245ADBR SN74LVTH273DBR SN74LVTH373DBR
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