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基于CPLD的PSK系統(tǒng)設(shè)計(jì)
摘要：本論文主要討論和仿真了基于cpld的psk系統(tǒng)單元設(shè)計(jì)，在闡述調(diào)制解調(diào)系統(tǒng)的基本原理與設(shè)計(jì)方法的同時(shí)，又詳細(xì)地介紹了系統(tǒng)的總體電路框圖及各個(gè)模塊的具體軟硬件實(shí)現(xiàn)。作者以vhdl作為設(shè)計(jì)的硬件描述語言，在altera公司的maxplus2開發(fā)平臺(tái)上進(jìn)行了程序設(shè)計(jì)及波形仿真。“自頂向下”是本設(shè)計(jì)的主要特色，所有程序都通過了以epm7128slc84-7作為主芯片的cpld實(shí)驗(yàn)開發(fā)板的硬件調(diào)試。關(guān)鍵詞：調(diào)制解調(diào)、cpld、vhdl 1 引言現(xiàn)代通信系統(tǒng)要求通信距離遠(yuǎn)、通信容量大、傳輸質(zhì)量好。作為其關(guān)鍵技術(shù)之一的調(diào)制解調(diào)技術(shù)一直是人們研究的一個(gè)重要方向[5]。從模擬調(diào)制到數(shù)字調(diào)制，從二進(jìn)制發(fā)展到多進(jìn)制調(diào)制，雖然調(diào)制方式多種多樣，但都是朝著使通信系統(tǒng)更高速、更可靠的方向發(fā)展。一個(gè)系統(tǒng)的通信質(zhì)量，很大程度上依賴于所采用的調(diào)制方式。因此，對調(diào)制方式的研究，將直接決定著通信系統(tǒng)質(zhì)量的好壞[1]。復(fù)雜可編程邏輯器件（cpld）結(jié)合了專用集成電路和dsp的優(yōu)勢，既具有很高的處理速度，又具有一定的靈活性。因此，基于cpld的數(shù)字調(diào)制系統(tǒng)的研究具有重要的實(shí)際意義。本文論述了如何用
CPLD的PSK系統(tǒng)設(shè)計(jì)
圖4-5 絕對碼-相對碼轉(zhuǎn)換模塊的vhdl模型方框圖由此，可得到絕對碼—相對碼轉(zhuǎn)換模塊的vhdl模型方框圖，如圖4-5所示。圖中的計(jì)數(shù)器與圖4-3中的計(jì)數(shù)器相同，異或門與寄存器共同完成絕/相變換功能。相對碼—絕對碼轉(zhuǎn)換模塊與此類似，此處就不加以論述。 5 系統(tǒng)調(diào)試總結(jié) 本課題研究并追蹤了通信領(lǐng)域和eda設(shè)計(jì)領(lǐng)域的兩項(xiàng)關(guān)鍵技術(shù)——調(diào)制解調(diào)技術(shù)和可編程邏輯技術(shù)，所有設(shè)計(jì)工作都是在一塊cpld實(shí)驗(yàn)開發(fā)板上完成的，選用了altera公司型號(hào)為epm7128slc84-7作為主芯片的。其中輸入信號(hào)由單片機(jī)提供，經(jīng)過cpld處理后，輸出信號(hào)的波形可通過示波器觀察[6]。但由于調(diào)制系統(tǒng)與解調(diào)系統(tǒng)的測試是分開進(jìn)行的，這樣勢必有不直觀性，并且未能考慮到實(shí)際系統(tǒng)中的不定因素。而以上這些，是本設(shè)計(jì)將來要進(jìn)一步改善與發(fā)展的地方。（沈琰李龍江）來源:零八我的愛

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