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問個編成遇到的低級問題 |
| 作者：cmsdpj 欄目：EDA技術(shù) |
LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; ..... SINT:=AA+BB+CIN; ...... 編譯時出現(xiàn)下面的錯誤,好像是我的庫不支持+,我也調(diào)了其他庫,但都沒用,請大蝦指點(diǎn)哈,謝謝! Error (10327): VHDL error at ADDER16B.VHD(17): can't determine definition of operator ""+"" -- found 0 possible definitions |
| 2樓： | >>參與討論 |
| 作者： oaipoaip 于 2006/6/9 20:42:00 發(fā)布：
use ieee.std_logic_arith.all; |
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| 3樓： | >>參與討論 |
| 作者： cpld163 于 2006/6/9 22:12:00 發(fā)布：
re 進(jìn)來灌一貼，樓上的牛人��！ |
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| 4樓： | >>參與討論 |
| 作者： cmsdpj 于 2006/6/10 10:15:00 發(fā)布：
re 我 加了，是一樣的提示，在IEEE庫里，我沒有找到std_logic_arith這個包集合阿，是不是要另外安裝呢 謝謝 |
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| 5樓： | >>參與討論 |
| 作者： oaipoaip 于 2006/6/10 13:42:00 發(fā)布：
在synopsys里面 在synopsys里面 LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; USE IEEE.STD_LOGIC_ARITH.ALL; USE IEEE.STD_LOGIC_UNSIGNED.ALL; |
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