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請(qǐng)問(wèn)哪位知道怎樣在FPGA設(shè)計(jì)中使用無(wú)源晶振輸入時(shí)鐘？謝謝 |
| 作者：zoo713 欄目：EDA技術(shù) |
謝謝 |
| 2樓： | >>參與討論 |
| 作者： 吳明詩(shī) 于 2006/6/5 15:45:00 發(fā)布：
用兩個(gè)非門 但不好，聯(lián)不上專用時(shí)鐘布線層，時(shí)鐘質(zhì)量不高 |
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| 3樓： | >>參與討論 |
| 作者： tjsheep 于 2006/6/8 20:40:00 發(fā)布：
最好找支持片上pll的就可以了 |
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