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ALTERA CPLD下載編程問題 |
| 作者：zwcwy 欄目：EDA技術 |
電路板上有其他芯片時，比如單片機等，用并口下載線編程時經(jīng)常失敗，取下這些外圍芯片編程就正常了，這些外圍芯片與CPLD的IO引腳有連接，但與編程的4個引腳沒有連接，這是什么原因？如何解決？ * - 本貼最后修改時間：2006-3-7 10:46:22 修改者：zwcwy |
| 2樓： | >>參與討論 |
| 作者： zcs_1 于 2006/3/7 13:39:00 發(fā)布：
檢查一下電平 |
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| 3樓： | >>參與討論 |
| 作者： jtzhang333 于 2006/3/15 11:27:00 發(fā)布：
具體要怎么做？ 具體要怎么做？ |
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| 4樓： | >>參與討論 |
| 作者： 吳明詩 于 2006/3/15 11:42:00 發(fā)布：
一點，cpld工作時能下載么？ 當有外圍cpu的時候，通上電cpld要是配置了的話，它就已經(jīng)開始工作了。如何配？ |
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| 5樓： | >>參與討論 |
| 作者： zjz0319 于 2006/3/19 10:32:00 發(fā)布：
RE: 可能存在干擾!你在JTAG口的TCK腳加一150P的電容看看. |
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