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FPGA接收LVPECL電平的問題 |
| 作者：ndjerry 欄目：EDA技術(shù) |
我有17路差分LVPECL信號（16路數(shù)據(jù)和一路時鐘），想將它們輸入到CycloneFPGA中。但問題是Cyclone的I/O口不支持LVPECL電平。如果用傳統(tǒng)的戴維寧終端匹配的話板子的功耗會很大。所以想請教各路高手，有沒有什么好的匹配方式？萬分感謝！ |
| 2樓： | >>參與討論 |
| 作者： daiduohao 于 2005/3/21 17:15:00 發(fā)布：
re Cyclone的LVDS接口可以和LVPECL實現(xiàn)匹配，你研究一下二者的輸入輸出結(jié)構(gòu)就可以搞定，需要關(guān)注一下PECL的直流偏置和LVDS的共模電壓。 |
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| 3樓： | >>參與討論 |
| 作者： jokeshe 于 2005/3/22 20:58:00 發(fā)布：
為什么不用SPARTAN3呢。 SPARTAN3直接支持LVPECL的。 如果CYCLONE里面數(shù)據(jù)手冊里面沒說明支持LVPECL，肯定就是不支持的。 |
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| 4樓： | >>參與討論 |
| 作者： daiduohao 于 2005/3/24 18:29:00 發(fā)布：
re 不管是否支持LVPECL都可以對接，只要LVPECL的速率在600Mbps（經(jīng)驗值）以下 |
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| 5樓： | >>參與討論 |
| 作者： ndjerry 于 2005/3/27 21:43:00 發(fā)布：
參考設(shè)計 謝謝daiduohao 大俠的指點！您能給個參考的匹配方案嗎？ 由于數(shù)據(jù)速率比較高（16路數(shù)據(jù)和一路時鐘均是155.52Mb/s），我以前采用多片電平轉(zhuǎn)換芯片將LVPECL電平轉(zhuǎn)換到LVTTL后在輸入到FPGA，效果很差。所以想直接通過電阻網(wǎng)絡(luò)進(jìn)行轉(zhuǎn)換，不知道可行否？能否給個參考呢？萬分感謝！ |
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