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請教大蝦，當用Max II對VHDL程序編譯時出現(xiàn)如下錯誤該如何修改？ |
| 作者：IcedSun 欄目：EDA技術(shù) |
請教各位大蝦，當用Max II對VHDL程序進行編譯過程中出現(xiàn)如下錯誤該如何修改？ 謝謝！
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| 2樓： | >>參與討論 |
| 作者： IcedSun 于 2005/1/28 20:06:00 發(fā)布：
…… 器件用的是EPM7128SLC84-6 |
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| 3樓： | >>參與討論 |
| 作者： zzyclever 于 2005/2/2 13:34:00 發(fā)布：
看一下程序！ |
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| 4樓： | >>參與討論 |
| 作者： IcedSun 于 2005/2/3 23:21:00 發(fā)布：
程序如下 --**************************************************** LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; USE IEEE.STD_LOGIC_ARITH.ALL; USE IEEE.STD_LOGIC_UNSIGNED.ALL; --**************************************************** ENTITY SHIFT_R4 IS PORT( DIN,CP :IN STD_LOGIC; DIR :IN STD_LOGIC; OP :OUT STD_LOGIC ); END SHIFT_R4; --**************************************************** ARCHITECTURE a OF SHIFT_R4 IS SIGNAL Q :STD_LOGIC_VECTOR(7 DOWNTO 0); BEGIN PROCESS(CP) BEGIN IF CP'EVENT AND CP='1' THEN IF DIR='0' THEN Q(0)<=DIN; FOR I IN 1 TO 7 LOOP Q(I)<=Q(I-1); END LOOP; ELSE Q(7)<=DIN; FOR I IN 7 DOWNTO 1 LOOP Q(I-1)<=Q(I); END LOOP; END IF; END IF; END PROCESS; OP<=Q(0) WHEN DIR='1' ELSE Q(7); END a; |
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| 5樓： | >>參與討論 |
| 作者： picklas 于 2005/2/4 7:18:00 發(fā)布：
re 查一下你的管腳分配是不是沖突了，代碼應該沒什么問題 |
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| 6樓： | >>參與討論 |
| 作者： IcedSun 于 2005/2/4 18:59:00 發(fā)布：
好的，謝謝！ |
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| 7樓： | >>參與討論 |
| 作者： zzyclever 于 2005/2/7 12:51:00 發(fā)布：
程序編譯通過!看一下你的管腳定義是否正確. 我在機子上試了,程序編譯通過!看一下你的管腳定義是否正確.是否有管腳沖突? |
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