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Z9973BA Datasheet

  • Z9973BA

  • TWELVE DISTRIBUTED-OUTPUT CLOCK DRIVER|TQFP|52PIN|PLASTIC

  • 11頁

  • ETC

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Z9973
3.3V, 125MHz, Multi-Output Zero Delay Buffer
Product Features
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鈥?/div>
Output Frequency up to 125MHz
TM
TM
Supports PowerPC , and Pentium Processors
12 Clock Outputs: Frequency Configurable
Configurable Output Disable
Two Reference Clock Inputs for Dynamic Toggling
Oscillator or PECL Reference Input
Spread Spectrum Compatible
Glitch-free Output Clocks Transitioning
3.3V Power Supply
Pin Compatible with MPC973
Industrial Temp. Range: -40擄C to +85擄C
52-Pin TQFP Package
Frequency Table *
VCO_SEL
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
FB_SEL2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
FB_SEL1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
Table 1
Block Diagram
PECL_CLK
PECL_CLK#
VCO_SEL
PLL_EN
REF_SEL
D Q
TCLK0
TCLK1
TCLK_SEL
FB_IN
D Q
Sync
Frz
0
1
Phase
Detector
LPF
VCO
0
1
Sync
Frz
QA0
QA1
QA2
QA3
FB_SEL0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
F
VCO
8x
12x
16x
20x
16x
24x
32x
40x
4x
6x
8x
10x
8x
12x
16x
20x
* x = the reference input frequency, 200MHz < F
VCO
<
480MHz.
Pin Configuration
SELB1
SELB0
SELA1
SELA0
QA3
VDDC
QA2
VSS
QA1
VDDC
QA0
VSS
VCO_SEL
52 51 50 49 48 47 46 45 44 43 42 41 40
QB0
QB1
FB_SEL2
QB2
QB3
MR#/OE
Power-On
Reset
SELA(0,1)
SELB(0,1)
SELC(0,1)
FB_SEL(0,1)
SCLK
SDATA
INV_CLK
Output Disable
Circuitry
12
2
2
2
2
/4, /6, /8, /10
Sync Pulse
Data Generator
D Q
/2
0
1
D Q
D Q
/4, /6, /8, /12
/4, /6, /8, /10
/2, /4, /6, /8
D Q
Sync
Frz
QC0
QC1
Sync
Frz
Sync
Frz
Sync
Frz
QC2
QC3
FB_OUT
VSS
MR#/OE
SCLK
SDATA
FB_SEL2
PLL_EN
REF_SEL
TCLK_SEL
TCLK0
TCLK1
PECL_CLK
PECL_CLK#
VDD
1
2
3
4
5
6
7
8
9
10
11
12
13
Z9973
39
38
37
36
35
34
33
32
31
30
29
28
27
VSS
QB0
VDDC
QB1
VSS
QB2
VDDC
QB3
FB_IN
VSS
FB_OUT
VDDC
FB_SEL0
14 15 16 17 18 19 20 21 22 23 24 25 26
FB_SEL1
SYNC
VSS
QC0
VDDC
QC1
SELC0
SELC1
QC2
VDDC
QC3
VSS
INV_CLK
SYNC
Cypress Semiconductor Corporation
525 Los Coches St.
Milpitas, CA 95035. Tel: 408-263-6300, Fax: 408-263-6571
http://www.cypress.com
Document#: 38-07089 Rev. **
9/15/2000
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    3.3V, 125-MHz, Multi-Output Zero Delay Buffer
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    3.3V, 125-MHz, Multi-Output Zero Delay Buffer
    CYPRESS [C...
  • 英文版
    3.3V, 125-MHz, Multi-Output Zero Delay Buffer
    CYPRESS [C...
  • 英文版
    3.3V, 125-MHz, Multi-Output Zero Delay Buffer
    CYPRESS
  • 英文版
    3.3V, 150MHz, Multi-Output Zero Delay Buffer
    CYPRESS [C...
  • 英文版
    MISCELLANEOUS CLOCK GENERATOR|QFP|52PIN|PLASTIC
    ETC
  • 英文版
    TWELVE DISTRIBUTED-OUTPUT CLOCK DRIVER|TQFP|52PIN|PLASTIC
    ETC
  • 英文版
    FOURTEEN DISTRIBUTED-OUTPUT CLOCK DRIVER|TQFP|52PIN|PLASTIC
    ETC
  • 英文版
    FOURTEEN DISTRIBUTED-OUTPUT CLOCK DRIVER|TQFP|52PIN|PLASTIC
  • 英文版
    3.3V, 150MHz, Multi-Output Zero Delay Buffer
    CYPRESS [C...

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