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Z9960 Datasheet

  • Z9960

  • 2.5V/3.3V, 200 MHz Multi-Output Zero Delay Buffer

  • 7頁

  • CYPRESS

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Z9960
2.5V/3.3V, 200 MHz Multi-Output Zero Delay Buffer
Features
鈥?2.5V or 3.3V operation
鈥?Output frequency up to 200 MHz
鈥?/div>
Supports PowerPC錚? and Pentium廬 processors
鈥?21 clock outputs: drive up to 42 clock lines
鈥?LVPECL or LVCMOS/LVTTL clock input
鈥?Output-to-output skew < 150 ps
鈥?Split 2.5V/3.3V outputs
鈥?Spread spectrum compatible
鈥?Glitch-free output clocks transitioning
鈥?Output disable control
鈥?Pin-compatible with MPC9600
鈥?Industrial temperature range: 鈥?0擄C to +85擄C
鈥?48-pin LQFP package
S
E
L
A
0
1
S
E
L
B
0
1
S
E
L
C
0
1
Table 1. Frequency Table
[1]
F
B
_
S
E
L
0
1
QA
VCO/2
VCO/4
QB
VCO/2
VCO/4
QC
VCO/2
VCO/4
FB_OUT
VCO/8
VCO/12
Block Diagram
AVDD
Pin Configuration
A
PLL
0
1
/2
/4
/8
/12
0
1
DQ
0
1
REF
FB
1
2
3
4
5
6
0
1
2
3
4
5
C
FB_IN
SELA
VSS
FB_IN
QA0
QA1
VDDA
QA2
QA3
VSSA
QA4
QA5
QA6
VDDA
48 47 46 45 44 43 42 41 40 39 38 37
VSS
TCLK
PECL_CLK
PECL_CLK#
VDD
REF_SEL
FB_SEL
AVDD
SELA
SELB
SELC
VSSC
1
2
3
4
5
6
7
8
9
10
11
12
36
35
34
33
32
31
30
29
28
27
26
25
VSSA
FB_OUT
QB0
QB1
VDDB
QB2
QB3
VSSB
QB4
QB5
QB6
VDDB
REF_SEL
TCLK
PECL_CLK
PECL_CLK#
0
0
1
B
DQ
SELB
Z9960
0
1
DQ
6
0
1
2
3
4
5
6
SELC
13 14 15 16 17 18 19 20 21 22 23 24
VDDC
OE#
QC6
QC5
VSSC
QC4
QC3
VDDC
QC2
QC1
QC0
VSSB
OE#
0
1
FB
DQ
FB_OUT
FB_SEL
Note:
1. Input frequency range: 16 MHz to 33 MHz (FB_SEL = 1), or 25 MHz to 50 MHz (FB_SEL = 0).
Cypress Semiconductor Corporation
Document #: 38-07087 Rev. *C
鈥?/div>
3901 North First Street
鈥?/div>
San Jose
,
CA 95134
鈥?/div>
408-943-2600
Revised May 03, 2004

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    2.5V/3.3V, 200 MHz Multi-Output Zero Delay Buffer
    CYPRESS
  • 英文版
    2.5V/3.3V, 200 MHz Multi-Output Zero Delay Buffer
    CYPRESS [C...
  • 英文版
    TWENTY-ONE DISTRIBUTED-OUTPUT CLOCK DRIVER|QFP|48PIN|PLASTIC
    ETC
  • 英文版
    TWENTY-ONE DISTRIBUTED-OUTPUT CLOCK DRIVER|QFP|48PIN|PLASTIC

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