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WED3DL644V-BC Datasheet

  • WED3DL644V-BC

  • SDRAM MCP

  • 27頁

  • ETC

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White Electronic Designs
4Mx64 SDRAM
FEATURES
n
n
n
n
n
n
53% Space Savings vs. Monolithic Solution
Reduced System Inductance and Capacitance
3.3V Operating Supply Voltage
Fully Synchronous to Positive Clock Edge
Clock Frequencies of 133, 125 and 100MHz
Burst Operation
聲 Sequential or Interleaved
聲 Burst Length = Programmable 1, 2, 4, 8 or Full Page
聲 Burst Read and Write
聲 Multiple Burst Read and Single Write
WED3DL644V
DESCRIPTION
The WED3DL644V is a 4Mx64 Synchronous DRAM con-
figured as 4x1Mx64. The SDRAM BGA is constructed
with four 4Mx16 SDRAM die mounted on a multi-layer
laminate substrate and packaged in a 119 lead, 14mm
by 22mm, BGA.
The WED3DL644V is available in clock speeds of
133MHz, 125MHz and 100MHz. The range of operating
frequencies, programmable burst lengths and program-
mable latencies allow the same device to be useful for a
variety of high bandwidth, high performance memory sys-
tem applications.
The package and design provides performance enhance-
ments via a 50% reduction in capacitance vs. four mono-
lithic devices. The design includes internal ground and
power planes which reduces inductance on the ground
and power pins allowing for improved decoupling and a
reduction in system noise.
n
n
n
n
n
Data Mask Control Per Byte
Auto and Self Refresh
Automatic and Controlled Precharge Commands
Suspend Mode and Power Down Mode
17mm x 23mm, 153 BGA
FIG. 1
PINOUT (T
OP
A
B
C
D
E
F
G
H
J
K
L
M
N
P
R
T
U
1
DQ
41
DQ
40
DQ
33
DQ
32
NC
NC
CE
2
NC
NC
NC
CE
1
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NC
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30
DQ
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22
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23
2
3
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43
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35
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37
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34
DQ
36
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2
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DDQ
V
DDQ
CE
3
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NC
V
SS
CKE
CAS
NC
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SS
CE
0
V
SS
V
DDQ
V
DDQ
DQMH
1
DQML
1
DQ
28
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DQ
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DQ
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DQ
20
DQ
18
DQ
21
DQ
19
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DQ
47
DQ
46
DQ
39
DQ
38
V
DD
V
DD
V
SS
CLK
1
RAS
CLK
0
V
SS
V
DD
V
DD
DQ
24
DQ
25
DQ
16
DQ
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5
NC
NC
NC
NC
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V
DD
V
SS
V
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WE
V
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V
SS
V
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V
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NC
NC
NC
VIEW
)
6
DQ
48
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49
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DD
V
DD
V
SS
V
SS
A
9
V
SS
V
SS
V
DD
V
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DQ
06
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15
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50
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52
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DQ
60
DQ
59
DQ
61
DQML
3
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3
V
DDQ
V
DDQ
V
SS
A
4
V
SS
A
5
A
11
A
6
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SS
A
7
V
SS
A
8
V
DDQ
V
DDQ
DQMH
0
DQML
0
DQ
04
DQ
02
DQ
05
DQ
03
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12
DQ
10
DQ
13
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11
9
DQ
54
DQ
55
DQ
62
DQ
63
NC
A
3
A
2
A
1
A
0
A
10
BA
1
BA
0
NC
DQ
00
DQ
01
DQ
08
DQ
09
PIN DESCRIPTION
A
0
聳 A
11
Address Bus
BA
0-1
Bank Select Addresses
DQ
0-63
Data Bus
CLK
0-1
Clock
CKE
Clock Enable
DQML
0-3
Data Input/Output Masks
DQMH
0-3
RAS
Row Address Strobe
CAS
Column Address Strobe
WE
Write Enable
CE
0-3
Chip Enables
V
DD
Power Supply pins, 3.3V
V
DDQ
Data Bus Power Supply, 3.3V
V
SS
Ground pins
August 2002 Rev.1
ECO #15464
1
White Electronic Designs Corporation 聲 (508) 366-5151聲 www.whiteedc.com

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