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W134MH Datasheet

  • W134MH

  • Miscellaneous Clock Generator

  • 10頁(yè)

  • ETC

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1W137
W137
FTG for Mobile 440BX & Transmeta鈥檚 Crusoe CPU
Features
鈥?Maximized EMI suppression using Cypress鈥檚 Spread
Spectrum Technology
鈥?Two copies of CPU output
鈥?Six copies of PCI output (Synchronous w/CPU output)
鈥?One 48-MHz output for USB support
鈥?One selectable 24-/48-MHz output
鈥?Two Buffered copies of 14.318-MHz input reference
signal
鈥?Supports 100-MHz or 66-MHz CPU operation
鈥?Power management control input pins
鈥?Available in 28-pin SSOP (209 mils) and 28-pin TSSOP
(173 mils)
鈥?SS function can be disabled
鈥?See W40S11-02 for 2 SDRAM DIMM support
PCI_F, PCI1:5 Output to Output Skew:........................500 ps
PCI_F, PCI1:5 Cycle to Cycle Jitter: ............................250 ps
CPU to PCI Output Skew: ............... 1.5鈥?.0 ns (CPU Leads)
Output Duty Cycle: .................................................... 45/55%
PCI_F, PCI Edge Rate: .............................................. >1 V/ns
CPU_STOP#, OE, SPREAD#, SEL48#, PCI_STOP#,
PWR_DWN# all have a 250-k鈩?pull-up resistor.
Table 1. Pin Selectable Frequency
SEL100/66#
0/1
0
1
OE
0
1
1
CPU
HI-Z
66.6 MHz
100 MHz
PCI
HI-Z
33.3
33.3
Spread %
Don鈥檛 Care
See
Table 2
See
Table 2
Key Specifications
Supply Voltages: ....................................... V
DDQ3
= 3.3V鹵5%
V
DDQ2
= 2.5V鹵5%
CPU0:1 Output to Output Skew: ................................ 175 ps
CPU0:1 Cycle to Cycle Jitter: ..................................... 200 ps
Table 2. Spread Spectrum Feature
SPREAD#
0
1
Spread Profile
鈥?.5% (down spread)
0% (spread disabled)
Block Diagram
X1
X2
CPU_STOP#
Pin Configuration
2
REF0:1
XTAL
OSC
STOP
Clock
Logic
4
CPU0:1
2
SPREAD#
梅2
CPUdiv2_0:1
PLL 1
SEL100/66#
梅2/梅1.5
STOP
Clock
Logic
1
PCI_F
STOP
Clock
Logic
7
PCI1:5
GND
X1
X2
PCI_F
PCI1
PCI2
GND
VDDQ3
PCI3
PCI4
PCI5
VDDQ3
48MHz
24/48MHz/OE
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
VDDQ3
REF0/SEL48#
REF1/SPREAD#
VDDQ2
CPU0
CPU1
GND
GND
PCI_STOP#
VDDQ3
CPU_STOP#
PWR_DWN#
SEL100/66#
GND
PWRDWN#
PCI_STOP#
梅2
Power
Down
Logic
梅2
Three-state
Logic
PLL2
1
48MHz
Cypress Semiconductor Corporation
鈥?/div>
3901 North First Street
鈥?/div>
San Jose
鈥?/div>
CA 95134 鈥?408-943-2600
March 16, 2001 Rev. *B

W134MH 產(chǎn)品屬性

  • 55

  • 集成電路 (IC)

  • 時(shí)鐘/計(jì)時(shí) - 專用

  • -

  • 時(shí)鐘/頻率發(fā)生器

  • 是

  • 存儲(chǔ)器，RDRAM

  • 時(shí)鐘

  • RSL

  • 1

  • 1:1

  • 無(wú)/是

  • 400MHz

  • 3.135 V ~ 3.465 V

  • 0°C ~ 70°C

  • 表面貼裝

  • 24-SSOP（0.154"，3.90mm 寬）

  • 24-QSOP

  • 管件

  • 428-1474

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    廠商
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  • 英文版
    Clocks and Buffers
    ETC
  • 英文版
    Direct Rambus Clock Generator
    CYPRESS
  • 英文版
    Direct Rambus Clock Generator
    CYPRESS [C...
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    Direct Rambus Clock Generator
    CYPRESS
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    CYPRESS [C...
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    Miscellaneous Clock Generator
    ETC
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    CYPRESS
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    CYPRESS [C...
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    Direct Rambus Clock Generator
    CYPRESS
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    Direct Rambus Clock Generator
    CYPRESS [C...
  • 英文版
    Direct Rambus⑩ Clock Generator
    CYPRESS [C...
  • 英文版
    Processor Specific Clock Generator, CMOS, PDSO24, 0.150 INCH...
    CYPRESS
  • 英文版
    Direct Rambus Clock Generator
    CYPRESS
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    Direct Rambus Clock Generator
    CYPRESS [C...
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    Processor Specific Clock Generator, CMOS, PDSO24, 0.150 INCH...
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