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SEMD48 Datasheet

  • SEMD48

  • NPN/PNP Silicon Digital Transistor Array Preliminary data

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SEMD48
NPN/PNP Silicon Digital Transistor Array
Preliminary data
鈥?/div>
Switching circuit, inverter, interface circuit,
driver circuit
鈥?/div>
Two (galvanic) internal isolated NPN/PNP
Transistors in one package
鈥?/div>
Built in bias resistor
NPN:
R
1
= 47k鈩?
R
2
= 47k鈩?/div>
PNP:
R
1
= 2.2k鈩?
R
2
= 47k鈩?/div>
Tape loading orientation
Top View
3 2 1
4
5
3
6
1
2
C1
6
B2
5
E2
4
Marking on SOT666 package
(for example W R)
corresponds to pin 1 of device
Position in tape: pin 1
same of feed hole
side
R
2
R
1
TR1
R
2
1
E1
2
B1
3
C2
EHA07176
TR2
R
1
4 5 6
Direction of Unreeling
Type
SEMD48
Maximum Ratings
Parameter
Collector-emitter voltage
Collector-base voltage
Emitter-base voltage
Emitter-base voltage
Input on voltage
Input on voltage
DC collector current
DC collector current
Junction temperature
Storage temperature
NPN
PNP
NPN
PNP
NPN
PNP
Total power dissipation,
T
S
= 75 擄C
WR
Marking
WT
Pin Configuration
Package
1=E1 2=B1 3=C2 4=E2 5=B2 6=C1 SOT666
Symbol
V
CEO
V
CBO
V
EBO
V
EBO
V
i(on)
V
i(on)
I
C
I
C
P
tot
T
j
T
stg
Value
50
50
10
5
50
10
70
100
250
150
-65...+150
Unit
V
mA
mW
擄C
1
Feb-26-2004

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