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SEMD13 Datasheet

  • SEMD13

  • NPN/PNP Silicon Digital Transistor Array Preliminary data

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SEMD13
NPN/PNP Silicon Digital Transistor Array
Preliminary data
鈥?/div>
Switching circuit, inverter, interface circuit,
driver circuit
鈥?/div>
Two (galvanic) internal isolated NPN/PNP
Transistors in one package
鈥?/div>
Built in bias resistor (R1=4.7k鈩?
R
2 =47k鈩?
Tape loading orientation
Top View
3 2 1
4
5
3
6
1
2
Marking on SOT666 package
(for example W R)
corresponds to pin 1 of device
Position in tape: pin 1
same of feed hole
side
C1
6
B2
5
E2
4
R
2
R
1
TR1
R
2
1
2
B1
3
C2
EHA07176
TR2
R
1
4 5 6
Direction of Unreeling
Type
SEMD13
Maximum Ratings
Parameter
Collector-emitter voltage
Collector-base voltage
Emitter-base voltage
Input on Voltage
DC collector current
Total power dissipation,
T
S
= 75 擄C
Junction temperature
Storage temperature
Thermal Resistance
Junction - soldering point
1)
1For calculation of
R
thJA
please refer to Application Note Thermal Resistance
WR
E1
Marking
W6
Pin Configuration
Package
1=E1 2=B1 3=C2 4=E2 5=B2 6=C1 SOT666
Symbol
V
CEO
V
CBO
V
EBO
V
i(on)
I
C
P
tot
T
j
T
stg
Value
50
50
5
15
100
250
150
-65 ... 150
Unit
V
mA
mW
擄C
R
thJS
鈮?/div>
300
K/W
1
Feb-26-2004

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