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LH5324500 Datasheet

  • LH5324500

  • CMOS 24M (3M x 8/1.5M x 16) MROM

  • 61.12KB

  • 7頁

  • SHARP

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LH5324500
FEATURES
鈥?/div>
3,145,728 words
脳
8 bit organization
(Byte mode)
1,572,864 words
脳
16 bit organization
(Word mode)
鈥?/div>
Access time: 150 ns (MAX.)
鈥?/div>
Power consumption:
Operating: 357.5 mW (MAX.)
Standby: 550
碌W
(MAX.)
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Static operation
鈥?/div>
TTL compatible I/O
鈥?/div>
Three-state outputs
鈥?/div>
Single +5 V power supply
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Package: 44-pin, 600-mil SOP
DESCRIPTION
The LH5324500 is a 24M-bit mask-programmable
ROM organized as 3,145,728
脳
8 bits (Byte mode) or
1,572,864
脳
16 bits (Word mode) that can be selected
by a BYTE input pin. It is fabricated using silicon-gate
CMOS process technology.
CMOS 24M (3M
脳
8/1.5M
脳
16) MROM
PIN CONNECTIONS
44-PIN SOP
NC
A
18
A
17
A
7
A
6
A
5
A
4
A
3
A
2
A
1
A
0
CE
GND
OE
D
0
D
8
D
1
D
9
D
2
D
10
D
3
D
11
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
A
20
A
19
A
8
A
9
A
10
A
11
A
12
A
13
A
14
A
15
A
16
BYTE
GND
D
15
/A
-1
(LSB)
D
7
D
14
D
6
D
13
D
5
D
12
D
4
V
CC
5324500-1
TOP VIEW
Figure 1. Pin Connections for SOP Package
1

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