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LH532048 Datasheet

  • LH532048

  • CMOS 2M (128K x 16) MROM

  • 7頁

  • SHARP

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LH532048
FEATURES
鈥?/div>
131,072 words
脳
16 bit organization
鈥?/div>
Access time: 100 ns (MAX.)
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Static operation
鈥?/div>
TTL compatible I/O
鈥?/div>
Three-state outputs
鈥?/div>
Single +5 V power supply
鈥?/div>
Power consumption:
Operating: 412.5 mW (MAX.)
Standby: 550
碌W
(MAX.)
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Packages:
40-pin, 600-mil DIP
40-pin, 525-mil SOP
44-pin, 650-mil QFJ (PLCC)
DESCRIPTION
The LH532048 is a 2M-bit mask-programmable ROM
organized as 131,072
脳
16 bits. It is fabricated using
silicon-gate CMOS process technology.
40-PIN DIP
40-PIN SOP
CMOS 2M (128K
脳
16) MROM
PIN CONNECTIONS
TOP VIEW
NC
CE
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30
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V
CC
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5
A
4
A
3
A
2
A
1
A
0
532048-1
Figure 1. Pin Connections for DIP and
SOP Packages
44-PIN PLCC
V
CC
D
13
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14
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A
16
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15
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14
NC
NC
NC
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TOP VIEW
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1 44 43 42 41 40
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37
36
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A
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12
A
11
A
10
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9
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8
A
7
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6
A
5
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2
D
1
D
0
A
0
A
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2
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3
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532048-2
Figure 2. Pin Connections for QFJ
(PLCC) Package
1

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