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IZ4027B Datasheet

  • IZ4027B

  • Dual JK Flip-Flop

  • 51.91KB

  • 6頁(yè)

  • INTEGRAL

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TECHNICAL DATA
IW4027B
Dual JK Flip-Flop
The IW4027B is a Dual JK Flip-Flop which is edge-triggered and
features independent Set, Reset, and Clock inputs. Data is accepted
when the Clock is LOW and transferred to the output on the positive-
going edge of the Clock. The active HIGH asynchronous Reset and Set
are independent and override the J, K, or Clock inputs. The outputs are
buffered for best system performance.
鈥?/div>
鈥?/div>
鈥?/div>
Operating Voltage Range: 3.0 to 18 V
Maximum input current of 1
碌A(chǔ)
at 18 V over full package-
temperature range; 100 nA at 18 V and 25擄C
Noise margin (over full package temperature range):
1.0 V min @ 5.0 V supply
2.0 V min @ 10.0 V supply
2.5 V min @ 15.0 V supply
ORDERING INFORMATION
IW4027BN
Plastic
IW4027BD SOIC
IZ4027B
Chip
T
A
= -55擄 to 125擄 C for all packages
PIN ASSIGNMENT
LOGIC DIAGRAM
FUNCTION TABLE
Inputs
Set Reset Clock
L
H
H
L
L
L
PIN 16 =V
CC
PIN 8 = GND
L
H
L
H
L
L
L
L
X
X
X
J
X
X
X
L
H
L
H
K
X
X
X
L
L
H
H
Outputs
Q
n+1
L
H
H
Q
n+1
H
L
H
No change
H
L
Qn
L
H
Qn
X = don鈥檛 care
Qn+1 = State After Clock Positive Transition
INTEGRAL
1

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    Dual JK Flip-Flop
    INTEGRAL
  • 英文版
    Dual JK Flip-Flop
    INTEGRAL [...
  • 英文版
    12-Stage Binary Ripple Counter
    INTEGRAL
  • 英文版
    12-Stage Binary Ripple Counter
    INTEGRAL [...
  • 英文版
    Analog Multiplexer Demultiplexer
    ETC
  • 英文版
    Analog Multiplexer Demultiplexer
    ETC [ETC]

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