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CY28401OC Datasheet

  • CY28401OC

  • 100-MHz Differential Buffer for PCI Express and SATA

  • 14頁(yè)

  • CYPRESS

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CY28401
100-MHz Differential Buffer for PCI Express and SATA
Features
鈥?CK409 or CK410 companion buffer
鈥?Eight differential 0.7v clock pairs
鈥?Individual OE controls
鈥?Low CTC jitter (< 50 ps)
鈥?Programmable bandwidth
鈥?SRC_STOP# power management control
鈥?SMBus Block/Byte/Word Read and Write support
鈥?3.3V operation
鈥?PLL Bypass-configurable
鈥?Divide by 2 programmable
鈥?48-pin SSOP package
Functional Description
The CY28401 is a differential buffer and serves as a
companion device to the CK409 or CK410 clock generator.
The device is capable of distributing the Serial Reference
Clock (SRC) in PCI Express and SATA implementations.
Block Diagram
SRC_DIV2#
VDD
VSS
SRCT_IN
SRCC_IN
OE_0
OE_3
DIFT0
DIFCO
VSS
VDD
DIFT1
DIFC1
OE_1
OE_2
DIFT2
DIFC2
VSS
VDD
DIFT3
DIFC3
PLL/BYPASS#
SCLK
SDATA
Pin Configuration
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
VDD_A
VSS_A
IREF
LOCK
OE_7
OE_4
DIFT7
DIFC7
VSS
VDD
DIFT6
DIFC6
OE_6
OE_5
DIFT5
DIFC5
VSS
VDD
DIFT4
DIFC4
HIGH_BW#
SRC_STOP#
PWRDWN#
VSS
DIFT0
OE_[0:7]
SRC_STOP#
PWRDWN#
Output
Control
DIFC0
DIFT1
DIFC1
DIFT2
SCLK
SDATA
SRC_DIV2#
PLL/BYPASS#
SRCT_IN
SRCC_IN
SMBus
Controller
Output
Buffer
DIFC2
DIFT3
DIFC3
DIFT4
DIFC4
DIFT5
DIFC5
CY28401
DIV
HIGH_BW#
DIFT6
DIFC6
PLL
48 SSOP
DIFT7
DIFC7
LOCK
Cypress Semiconductor Corporation
Document #: 38-07592 Rev. **
鈥?/div>
3901 North First Street
鈥?/div>
San Jose
,
CA 95134
鈥?/div>
408-943-2600
Revised November 24, 2003

CY28401OC 產(chǎn)品屬性

  • 30

  • 集成電路 (IC)

  • 時(shí)鐘/計(jì)時(shí) - 專(zhuān)用

  • -

  • 時(shí)鐘緩沖器/驅(qū)動(dòng)器，多路復(fù)用器

  • 是

  • PCI Express（PCIe），SATA CPU

  • 時(shí)鐘

  • 時(shí)鐘

  • 1

  • 1:8

  • 是/是

  • 100MHz

  • 3.135 V ~ 3.465 V

  • 0°C ~ 70°C

  • *

  • *

  • *

  • *

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