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CY26187-2 Datasheet

  • CY26187-2

  • Clocks and Buffers

  • 5頁

  • ETC

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5
PRELIMINARY
CY26187-2
Broadcom Reference Design
Clock Generator
Features
鈥?Integrated phase-locked loop
鈥?Low skew, low jitter, high accuracy outputs
鈥?3.3V Operation
Broadcom Reference
Design
BCM5680_5404
Benefits
Highest Performance PLL tailored for multimedia applications
Meets critical timing requirements in complex system designs
Part Number
CY26187-2
Outputs
1
Input Frequency
50 MHz
Output Frequencies
1 copy of 142.8 MHz (3.3V)
Logic Block Diagram
OUTPUT
MULTIPLEXER
AND
DIVIDERS
VCO
P
50 XIN
XOUT
P Comp
OSC
Q
142.8 MHz
PLL
OE
VDD
VDD
VSS
VSS
Pin Configuration
CY26187
8-pin SOIC
XIN
AVDD
OE
AVSS
1
2
3
4
8
7
6
5
XOUT
VSS
142.8 MHz
VDD
Cypress Semiconductor Corporation
Document #: 38-07131 Rev. *A
鈥?/div>
3901 North First Street
鈥?/div>
San Jose
鈥?/div>
CA 95134 鈥?408-943-2600
Revised December 14, 2002

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