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CY26118 Datasheet

  • CY26118

  • Clocks and Buffers

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025/0251
PRELIMINARY
CY26118
19.6608-MHz Clock Generator
Features
鈥?Integrated phase-locked loop (PLL)
鈥?Low-jitter, high-accuracy outputs
鈥?3.3V operation
Part Number
CY26118
Outputs
1
Input Frequency Range
15.0000 MHz
19.6608 MHz
Output Frequencies
Benefits
Highest-performance PLL tailored for multimedia applications
Meets critical timing requirements in complex system designs
Logic Block Diagram
15.0000 XIN
OSC
XOUT
Q
桅
VCO
P
OUTPUT
DIVIDER
19.6608 MHz
Pin Configuration
CY26118
8-pin SOIC
XIN
AVDD
N/C
AVSS
1
2
3
4
8
7
6
5
XOUT
VSS
19.6608 MHz
VDD
PLL
AVDD VDD
AVSS
VSS
Cypress Semiconductor Corporation
Document #: 38-07274 Rev. *A
鈥?/div>
3901 North First Street
鈥?/div>
San Jose
鈥?/div>
CA 95134 鈥?408-943-2600
Revised December 14, 2001

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