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74LVQ86 Datasheet

  • 74LVQ86

  • QUAD EXCLUSIVE OR GATE

  • 60.16KB

  • 8頁

  • STMICROELECTRONICS   STMICROELECTRONICS

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廬
74LVQ86
QUAD EXCLUSIVE OR GATE
s
s
s
s
s
s
s
s
s
s
s
HIGH SPEED: t
PD
= 5.5 ns (TYP.) at V
CC
= 3.3V
COMPATIBLE WITH TTL OUTPUTS
LOW POWER DISSIPATION:
I
CC
= 2
碌A(chǔ)
(MAX.) at T
A
= 25
o
C
LOW NOISE:
V
OLP
= 0.3 V (TYP.) at V
CC
= 3.3V
75
鈩?/div>
TRANSMISSION LINE DRIVING
CAPABILITY
SYMMETRICAL OUTPUT IMPEDANCE:
|I
OH
| = I
OL
= 12 mA (MIN)
PCI BUS LEVELS GUARANTEED AT 24mA
BALANCED PROPAGATION DELAYS:
t
PLH
鈮?/div>
t
PHL
OPERATING VOLTAGE RANGE:
V
CC
(OPR) = 2V to 3.6V (1.2V Data Retention)
PIN AND FUNCTION COMPATIBLE WITH
74 SERIES 86
IMPROVED LATCH-UP IMMUNITY
M
(Micro Package)
T
(TSSOP Package)
ORDER CODES :
74LVQ86M
74LVQ86T
sub-micron silicon gate and double-layer metal
wiring C
2
MOS technology. It is ideal for low
power and low noise 3.3V applications.
It has better speed performance at 3.3V than 5V
LS-TTL family combined with the true CMOS low
power consumption.
All inputs and outputs are equipped with
protection circuits against static discharge, giving
them 2KV ESD immunity and transient excess
voltage.
DESCRIPTION
The LVQ86 is a low voltage CMOS QUAD
EXCLUSIVE OR GATE fabricated with
PIN CONNECTION AND IEC LOGIC SYMBOLS
February 1999
1/8

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