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74LVQ10M Datasheet

  • 74LVQ10M

  • LOGIC GATE|3 3-INPUT NAND|LVQ-CMOS|SOP|14PIN|PLASTIC

  • 58.96KB

  • 8頁

  • ETC

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74LVQ10
TRIPLE 3-INPUT NAND GATE
s
s
s
s
s
s
s
s
s
s
s
HIGH SPEED:
t
PD
= 5.3ns (TYP.) at V
CC
= 3.3 V
COMPATIBLE WITH TTL OUTPUTS
LOW POWER DISSIPATION:
I
CC
= 2碌A (MAX.) at T
A
=25擄C
LOW NOISE:
V
OLP
= 0.3V (TYP.) at V
CC
= 3.3V
75鈩?TRANSMISSION LINE DRIVING
CAPABILITY
SYMMETRICAL OUTPUT IMPEDANCE:
|I
OH
| = I
OL
= 12mA (MIN) at V
CC
= 3.0 V
PCI BUS LEVELS GUARANTEED AT 24 mA
BALANCED PROPAGATION DELAYS:
t
PLH
鈮?/div>
t
PHL
OPERATING VOLTAGE RANGE:
V
CC
(OPR) = 2V to 3.6V (1.2V Data Retention)
PIN AND FUNCTION COMPATIBLE WITH
74 SERIES 10
IMPROVED LATCH-UP IMMUNITY
SOP
TSSOP
ORDER CODES
PACKAGE
SOP
TSSOP
TUBE
74LVQ10M
T&R
74LVQ10MTR
74LVQ10TTR
DESCRIPTION
The 74LVQ10 is a low voltage CMOS TRIPLE
3-INPUT NAND GATE fabricated with sub-micron
silicon gate and double-layer metal wiring C
2
MOS
technology. It is ideal for low power and low noise
3.3V applications.
The internal circuit is composed of 3 stages
including buffer output, which enables high noise
immunity and stable output.
All inputs and outputs are equipped with
protection circuits against static discharge, giving
them 2KV ESD immunity and transient excess
voltage.
PIN CONNECTION AND IEC LOGIC SYMBOLS
July 2001
1/8

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