近年來，隨著海上運(yùn)輸業(yè)的發(fā)展，船舶朝著大型化、快速化、化方向發(fā)展，使得海上交通密度加大，航行環(huán)境復(fù)雜，交通事故不斷發(fā)生，給社會(huì)經(jīng)濟(jì)和海洋環(huán)境造成了重大損害。根據(jù)國外資料統(tǒng)計(jì)，每年失事的船舶約200 艘，總噸位數(shù)達(dá)到120萬噸，占世界船隊(duì)的0.4%左右，其中碰撞事故占到了43%，僅碰撞事故原因中是由于人為因素造成的占到了80%以上，因此研究船舶自動(dòng)避碰決策系統(tǒng)，逐漸實(shí)現(xiàn)航海自動(dòng)化是保障船舶航行安全的有效措施。船舶自動(dòng)識(shí)別系統(tǒng)（AIS）是一種無人操作的無線電通信系統(tǒng)，能自動(dòng)的通過VHF廣播和接受船舶的動(dòng)、靜態(tài)信息，自動(dòng)進(jìn)行船岸、船船之間的通信。根據(jù)SOLAS 公約的要求，所有300 總噸及以上的國際航行船舶和500 噸級(jí)及以上的非國際航行船舶均配備AIS 系統(tǒng)。

　　1 AIS的關(guān)鍵技術(shù)研究

　　AIS系統(tǒng)的硬件主要由四部分組成：

　　◆ 通信模塊：利用VHF數(shù)字通信通道轉(zhuǎn)發(fā)和接收廣播的GPS等船位信息；

　　◆ 信號(hào)采集部分：將接收到的信息經(jīng)過解碼，轉(zhuǎn)換位數(shù)字信號(hào)；

　　◆ 信息處理部分：采用一個(gè)嵌入式微處理器系統(tǒng)，構(gòu)成整機(jī)的控制中心，存儲(chǔ)、更新本船的動(dòng)靜態(tài)信息，將必要的信息送去發(fā)射，將部分信息送顯示器；

　　◆ 顯示部分：顯示重要的參數(shù)和信息，便于監(jiān)視。

　　2 船舶避碰系統(tǒng)整體結(jié)構(gòu)設(shè)計(jì)

　　本文是在AIS提供信息的基礎(chǔ)上，采用DSP和FPGA設(shè)計(jì)船舶避碰系統(tǒng)。其中高速浮點(diǎn)DSP作為AIS數(shù)據(jù)接收、船舶避碰算法和系統(tǒng)控制的微處理器。一塊容量合適的FPGA集成船舶避碰系統(tǒng)所需其他的I／O功能，實(shí)現(xiàn)外圍輸入輸出接口如其他串行口、ADC數(shù)據(jù)采集緩存等硬件電路，使部分?jǐn)?shù)據(jù)采集和數(shù)據(jù)通信的I／O任務(wù)由DSP和FPGA協(xié)同承擔(dān)。FPGA還可以實(shí)現(xiàn)液晶顯示接口和鍵盤接口。通常液晶顯示器帶有液晶顯示控制器，可以方便地與微處理器接口連接。液晶顯示接口減少了DSP的外設(shè)訪問時(shí)間。

　　根據(jù)船舶避碰系統(tǒng)的任務(wù)設(shè)計(jì)了系統(tǒng)整體結(jié)構(gòu)如圖1所示：AIS信息經(jīng)解碼、電平轉(zhuǎn)換進(jìn)入DSP串口，由于DSP芯片計(jì)算量大，需要存儲(chǔ)擴(kuò)展。其他傳感器的輸出信號(hào)經(jīng)調(diào)理及補(bǔ)償之后，經(jīng)A／D轉(zhuǎn)換進(jìn)入FPGA；GPS、雷達(dá)等輸出的串行數(shù)據(jù)由DSP通過FPGA內(nèi)串行口采集；系統(tǒng)輸出數(shù)據(jù)則由FPGA內(nèi)的液晶顯示接口送到液晶顯示控制器；為方便系統(tǒng)調(diào)試，在FPGA內(nèi)實(shí)現(xiàn)4×4小鍵盤接口；DSP與FPGA內(nèi)各模塊需進(jìn)行通信。

　　3 主要模塊設(shè)計(jì)

　　本方案中DSP主要用于AIS信號(hào)接收、船舶避碰參數(shù)運(yùn)算和系統(tǒng)控制。所以選擇C5402作為CPU，它可以根據(jù)需求工作在不同的模式下，主要用MP／MC的電平來決定，當(dāng)MP／MC為高電平時(shí)，DSP工作在微處理器模式，此時(shí)接收來自AIS的數(shù)據(jù)，當(dāng)MP／MC為低電平時(shí)，DSP工作在微計(jì)算機(jī)方式，用于避碰參數(shù)運(yùn)算和系統(tǒng)控制。

　　3.1 AIS信息的采集

　　AIS信息經(jīng)過鑒頻、解調(diào)電路、 RS 232電平轉(zhuǎn)換以后進(jìn)入微處理器。此處主要由軟件實(shí)現(xiàn)。系統(tǒng)程序包括系統(tǒng)初始化程序、串口中斷程序、數(shù)據(jù)處理程序、數(shù)據(jù)顯示程序等。系統(tǒng)的初始化包括串口初始化、變量定義、文件設(shè)置、數(shù)據(jù)庫的生成及處理等；串口中斷程序主要完成AIS數(shù)據(jù)的采集；數(shù)據(jù)處理程序主要完成將AIS輸出的數(shù)據(jù)格式轉(zhuǎn)換為其他基于 AIS信息的系統(tǒng)所需的格式，在數(shù)據(jù)處理過程中必須進(jìn)行AIS數(shù)據(jù)的校驗(yàn)判斷，以確保采集數(shù)據(jù)的可靠性；數(shù)據(jù)顯示程序主要完成AIS數(shù)據(jù)的顯示。其中信息解碼的程序流程圖如圖2所示。

　　3.2 DSP和FPGA的接口設(shè)計(jì)

　　比較Altera公司的多個(gè)系列的FPGA產(chǎn)品，本設(shè)計(jì)選取CycloneⅡ系列的芯片 EP2C35F672。它主要具有以下特性：嵌入式存儲(chǔ)資源支持各種存儲(chǔ)器應(yīng)用和數(shù)字信號(hào)處理（DSP）實(shí)施的要求，引腳數(shù)量充裕有160個(gè)，可提供 100個(gè)I／O用戶引腳，且I／O具有三態(tài)緩沖、總線狀態(tài)保持等功能，該芯片由128 MB FLASH內(nèi)存和8 MB SSRAM存儲(chǔ)區(qū)和兩個(gè)串口。它可以滿足本系統(tǒng)所需的數(shù)據(jù)采集控制和串行口復(fù)用等功能。接口電路如圖3所示。

　　在上述設(shè)計(jì)中AIS信息的串口直接接到DSP芯片上，是為了避免直接應(yīng)用多串行口中斷共享方式可能會(huì)不可靠。原因是假如在服務(wù)串行口A時(shí)上檢測過的串行口B發(fā)生了中斷，此時(shí)中斷服務(wù)程序如果直接退出，則中斷B就未被服務(wù)。退出中斷服務(wù)程序時(shí)，由于DSP中斷標(biāo)志位已經(jīng)被清除且DSP中斷引腳保持高電平，此時(shí)中斷就不會(huì)再被標(biāo)志，造成中斷死鎖導(dǎo)致外部中斷根本無法繼續(xù)工作。為確保DSP芯片及時(shí)接收到AIS信息，為AIS單獨(dú)留下專用串口。

　　3.3 DSP和FPGA與其他外圍電路的接口設(shè)計(jì)

　　船舶避碰系統(tǒng)中設(shè)計(jì)了基于同一片F(xiàn)PGA上的液晶顯示接口和鍵盤接口，使避碰系統(tǒng)具有更強(qiáng)的功能。鍵盤接口利用FPGA內(nèi)的硬件資源設(shè)計(jì)，在不影響DSP進(jìn)行船舶避碰算法運(yùn)算的條件下，用于船舶避碰系統(tǒng)的調(diào)試及控制。

　　同時(shí)完成了A／D、D／A模塊的接口設(shè)計(jì)。模擬信號(hào)經(jīng)過前置濾波、放大，再通過多路模擬開關(guān)和A／D轉(zhuǎn)換器轉(zhuǎn)換成數(shù)字信號(hào)進(jìn)入FPGA，A／D、D／A模塊與DSP的接口電路如圖4所示。

　　4  結(jié)  語

　　本文研究的內(nèi)容為基于AIS的船舶避碰系統(tǒng)，涉及到信息的解碼過程，利用DSP作為系統(tǒng)的微處理器和FPGA作為接口的擴(kuò)展與協(xié)調(diào)，根據(jù)接收的信息，進(jìn)行船舶避碰算法的運(yùn)算。