HFAN-04.5.5評(píng)估電源噪聲抑制比對(duì)PLL時(shí)鐘合成器的影響
出處：computer00 發(fā)布于：2009-06-23 14:32:44
摘要：本應(yīng)用筆記介紹了電源噪聲對(duì)基于PLL的時(shí)鐘發(fā)生器的干擾，并討論了幾種用于評(píng)估DJ (確定性抖動(dòng))的技術(shù)方案。推導(dǎo)出的關(guān)系式提供了利用頻域雜散分量測(cè)量評(píng)估時(shí)鐘抖動(dòng)性能的方法。利用實(shí)驗(yàn)室測(cè)量結(jié)果對(duì)不同的測(cè)量技術(shù)進(jìn)行比較，并闡述了如何可靠地評(píng)估參考時(shí)鐘發(fā)生器的PSNR (電源噪聲抑制)性能。
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