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安森美半導(dǎo)體拓展時鐘和數(shù)據(jù)管理產(chǎn)品系列至新型CML、LVDS和ECL接口
型為1 皮秒(ps)。其特點為創(chuàng)新開路集電極cml輸出，可以在混合電壓電平集成電路（1.8 v、2.5 v和 3.3 v）之間實現(xiàn)高速接口。此開路集電極輸出結(jié)構(gòu)使運行在與目標集成電路電壓不同的信號源可與之進行通信。因為現(xiàn)場可編程門陣列（fpga）和專用集成電路（asic）向更低運行電壓發(fā)展，該器件替代方案通常使用分立元件進行電平移動，由此增加傳播延遲、消耗板空間并增加成本。nb4n11m 無需轉(zhuǎn)換或電平移動。器件以3.3 v 的vcc進行運行，采用無鉛3 mm x 3 mm tssop-8封裝。nb4n11mdtr2g每2,500件的批量單價為4.13美元。 nb4n11s為配有l(wèi)vds輸出的1:2時鐘分配芯片，接受差動lvpecl、lvcmos、lvttl、cml或lvds輸入。其推出拓展安森美半導(dǎo)體行業(yè)領(lǐng)先的高性能lvds接口器件系列。lvds是fpga和asic的常見信號接口的廉宜價差動選擇。但傳統(tǒng)的以cmos為基礎(chǔ)的lvds器件欠缺提供低抖動、嚴格定時信號所需的速度和精確性。將安森美半導(dǎo)體前沿的雙極性功能與lvds的兼容輸出結(jié)構(gòu)相結(jié)合，這些lvds器件可更好地兼容主流集成電路而不犧牲性能。
安森美半導(dǎo)體推出新型CML、LVDS和ECL接口
5 ghz，而且抖動典型為1 皮秒(ps)。其特點為創(chuàng)新開路集電極cml輸出，可以在混合電壓電平集成電路(1.8v、2.5v和3.3v)之間實現(xiàn)高速接口。此開路集電極輸出結(jié)構(gòu)使運行在與目標集成電路電壓不同的信號源可與之進行通信。因為現(xiàn)場可編程門陣列(fpga)和專用集成電路(asic)向更低運行電壓發(fā)展，該器件替代方案通常使用分立元件進行電平移動，由此增加傳播延遲、消耗板空間并增加成本。nb4n11m無需轉(zhuǎn)換或電平移動。器件以3.3v的vcc進行運行，采用無鉛3mm×3mm tssop-8封裝。nb4n11mdtr2g每2,500件的批量單價為4.13美元。 nb4n11s為配有l(wèi)vds輸出的1:2時鐘分配芯片，接受差動lvpecl、lvcmos、lvttl、cml或lvds輸入。其推出拓展安森美半導(dǎo)體行業(yè)領(lǐng)先的高性能lvds接口器件系列。lvds是fpga和asic的常見信號接口的廉宜價差動選擇。但傳統(tǒng)的以cmos為基礎(chǔ)的lvds器件欠缺提供低抖動、嚴格定時信號所需的速度和精確性。將安森美半導(dǎo)體前沿的雙極性功能與lvds的兼容輸出結(jié)構(gòu)相結(jié)合，這些lvds器件可更好地兼容主流集成電路而不犧牲性能。該器
安森美拓展時鐘和數(shù)據(jù)管理系列
型為1 皮秒(ps)。其特點為創(chuàng)新開路集電極cml輸出，可以在混合電壓電平集成電路（1.8 v、2.5 v和 3.3 v）之間實現(xiàn)高速接口。此開路集電極輸出結(jié)構(gòu)使運行在與目標集成電路電壓不同的信號源可與之進行通信。因為現(xiàn)場可編程門陣列（fpga）和專用集成電路（asic）向更低運行電壓發(fā)展，該器件替代方案通常使用分立元件進行電平移動，由此增加傳播延遲、消耗板空間并增加成本。nb4n11m 無需轉(zhuǎn)換或電平移動。器件以3.3 v 的vcc進行運行，采用無鉛3 mm x 3 mm tssop-8封裝。nb4n11mdtr2g每2,500件的批量單價為4.13美元。 nb4n11s為配有l(wèi)vds輸出的1:2時鐘分配芯片，接受差動lvpecl、lvcmos、lvttl、cml或lvds輸入。其推出拓展安森美半導(dǎo)體行業(yè)領(lǐng)先的高性能lvds接口器件系列。lvds是fpga和asic的常見信號接口的廉宜價差動選擇。但傳統(tǒng)的以cmos為基礎(chǔ)的lvds器件欠缺提供低抖動、嚴格定時信號所需的速度和精確性。將安森美半導(dǎo)體前沿的雙極性功能與lvds的兼容輸出結(jié)構(gòu)相結(jié)合，這些lvds器件可更好地兼容主流集成電路而不犧牲性能。該器件的最大
安森美拓展時鐘和數(shù)據(jù)管理產(chǎn)品配備完全差動接口
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