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  • 基于片上系統(tǒng)的NO.7信令采集終端的設計

    1 的交叉連接及時隙交換。具體而言，若16 個e1 全部為 接收，則實現(xiàn)4 個8m（512 時隙，輸入）到2 個hdlc（scc2、scc3 共64 個時隙的交換， 輸出），具體操作由cpu 的控制來實現(xiàn)，然后送入fpga 內(nèi)嵌mpc860 的hdlc scc2、 scc3 進行信令處理，處理完畢后，由mpc860 的100m 以太網(wǎng)scc1 送到系統(tǒng)服務器。 3.1.2 邏輯部分 fpga 中還需要實現(xiàn)以下的兩個外圍模塊： 復位模塊：系統(tǒng)硬復位、各個器件（4 片pm4354、1 片mt9042、1 片lxt971 的軟復位）； 復位部分的設計，可以對所有的芯片完成硬復位，也可以根據(jù)要求，對某一個器件來完成軟 復位； 地址譯碼模塊：完成4 片pm4354 地址譯碼以及片選部分的譯碼電路設計 3.2 fpga 片上cpu860 軟件設計 3.2.1 運行過程 采集終端軟件固化在flash 上，終端上電后，首先運行初始引導程序，完成板級的初始 化工作，然后將操作系統(tǒng)裝入內(nèi)存并執(zhí)行，操作系統(tǒng)最后將應用程序裝入內(nèi)存并啟動。應用 程序即是上面介紹的四大模塊

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