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字ycbcr信號(hào)、同步/消隱控制信號(hào)、行場(chǎng)同步信號(hào)以及像素時(shí)鐘的選擇信號(hào).ths8134的作用是把fpga輸出的數(shù)字ycbcr信號(hào)轉(zhuǎn)換為模擬ypbpr信號(hào),再根據(jù)控制信號(hào)/sync、sync-t和/blank產(chǎn)生同步/消隱信號(hào)并把它疊加到模擬ypbpr信號(hào)上.ths8134的輸出,一組直接從ypbpr接口輸出,一組通過矩陣變換和同步切除,轉(zhuǎn)換為可供vga接口輸出的rgb信號(hào).2 頻率合成模塊和各種vga格式 頻率合成模塊的功能是在fpga的控制下,根據(jù)選擇信號(hào)產(chǎn)生相應(yīng)的像素時(shí)鐘信號(hào).選用mc12429作為時(shí)鐘產(chǎn)生芯片.mc12429是1個(gè)通用合成時(shí)鐘源,其內(nèi)部的壓控振蕩器(vco)可在200～400mhz范圍內(nèi)操作.該芯片的差分pecl輸出根據(jù)不同的設(shè)置可以是vco頻率的1、2、4或8分頻.輸出頻率可通過并行接口或串行接口來配置,筆者選用并行配置.并行接口根據(jù)mc12429的輸入腳m[8..0]、n[1...0]的值配置內(nèi)部計(jì)數(shù)器,產(chǎn)生所需要的時(shí)鐘.其輸出時(shí)鐘的計(jì)算式為:fout=(fxtal/16)m/n式中:m的推薦取值范圍是200～400;n取00代表1,取01代表2,取10代表4,取
輸出fout起動(dòng)a/d轉(zhuǎn)換器；（2）鎖存ad9051的輸出結(jié)果；（3）通過地址發(fā)生器輸出數(shù)據(jù)存儲(chǔ)地址，并產(chǎn)生寫信號(hào)（wr），將鎖存數(shù)據(jù)寫入sram。 1.2 控制電路的設(shè)計(jì) 控制電路的核心為at89c52，如圖3所示。控制電路要完成的任務(wù)是：（1）上電后，完成cpld的配置加載。flex10k系列共有4種加載方式，這里采用主動(dòng)串行方式，由at89c52的引腳p1.5控制cpld和已寫入配置數(shù)據(jù)的串行eprom（27e512）完成配置。（2）完成采樣頻率的控制，由at89c52控制時(shí)間合成芯片mc12429來實(shí)現(xiàn)，其輸出頻率為25～400mhz。每次采樣前，用戶可手動(dòng)輸入采樣頻率，由at89c52的p0.0～p0.7腳輸出m[8..1]的值，p1.0腳輸出由低到高的信號(hào)，將此值鎖存。（3）控制a/d轉(zhuǎn)換的使能。當(dāng)頻率設(shè)定好后，用戶按下采樣鍵，at89c52的p1.1輸出采樣使能信號(hào)smen，當(dāng)采樣開始信號(hào)smst到來后，采樣就開始進(jìn)行。（4）與cpld的通訊。圖3中，at89c52的p0.0～p0.7與cpld的8個(gè)i/o引腳相連，實(shí)現(xiàn)at89c52與cpld之間的數(shù)據(jù)通訊。它們之間的控制信號(hào)有讀
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