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hi-8585供應(yīng)商優(yōu)質(zhì)現(xiàn)貨

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hi-8585價(jià)格行情

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hi-8585中文資料

  • 基于DSP和FPGA的機(jī)載總線接口板研究

    送可以選擇單幀發(fā)送或自動(dòng)重復(fù)發(fā)送(重復(fù)發(fā)送某一幀)。 整個(gè)接口板由調(diào)制電路、解調(diào)電路、fpga、dsp和雙口ram組成,如圖2所示。 圖2 接口板硬件結(jié)構(gòu)圖 3 硬件電路設(shè)計(jì) 3.1 調(diào)制解調(diào)電路設(shè)計(jì) 429信號(hào)進(jìn)入接口板后,首先要把429信號(hào)轉(zhuǎn)換為數(shù)字電路可以識(shí)別的ttl電平。這里采用holt公司的hi-8482實(shí)現(xiàn)信號(hào)的解調(diào),將標(biāo)準(zhǔn)的429總線信號(hào)轉(zhuǎn)換成5v ttl數(shù)字信號(hào)。為了降低干擾,在429總線信號(hào)的四個(gè)輸入管腳分別接入39pf的高精度軍品電容;采用holt公司的hi-8585芯片實(shí)現(xiàn)信號(hào)的調(diào)制,將ttl數(shù)字電平轉(zhuǎn)換為標(biāo)準(zhǔn)的429信號(hào)。 3.2 fpga內(nèi)部邏輯設(shè)計(jì) 按照429信號(hào)的編碼格式、特點(diǎn)、傳輸規(guī)則以及協(xié)議要求,選用一片altera公司的acex1k型的fpga發(fā)送和接收四路數(shù)據(jù)。每一路分為接收部分和發(fā)送部分。 接收部分的主要作用是通過串/并轉(zhuǎn)換將串行數(shù)據(jù)轉(zhuǎn)換為32位并行數(shù)據(jù),并對(duì)收到的數(shù)據(jù)自動(dòng)實(shí)行差錯(cuò)控制。對(duì)于字間隔、位間隔出錯(cuò)等錯(cuò)誤能進(jìn)行自動(dòng)檢測,若無錯(cuò)誤,則將數(shù)據(jù)分兩次送至dsp的16位數(shù)據(jù)總線上,以供讀取。接收模塊結(jié)構(gòu)框圖如圖3所示。

  • ARINC429總線IP核設(shè)計(jì)及應(yīng)用探討

    。軟件開發(fā)人員可在測試計(jì)算機(jī)上完成功能多樣的應(yīng)用程序設(shè)計(jì),接收數(shù)據(jù)通過驅(qū)動(dòng)程序上傳至應(yīng)用程序,應(yīng)用程序也可將待發(fā)送數(shù)據(jù)通過驅(qū)動(dòng)程序?qū)懙桨蹇ㄖ?,所有收發(fā)數(shù)據(jù)均可利用軟件記錄并描述。 板卡的硬件設(shè)計(jì)框圖如圖5所示。在本應(yīng)用中,將ip核配置成8路接收通道和8路發(fā)送通道,經(jīng)綜合后下載至fpga中,fpga選用altera公司cyclone系列ep1c20,ip核和pci接口模塊綜合后共占用邏輯單元14 300個(gè),占總量的72%,存儲(chǔ)單元55 296個(gè),占總量的75%;arinc429總線驅(qū)動(dòng)芯片選用hi-8585和hi-8591;pci接口芯片選用pci9054。 在測試過程中,將應(yīng)用arinc249總線ip核的pci卡與計(jì)算機(jī)主板進(jìn)行連接,對(duì)pci卡的全部功能進(jìn)行驗(yàn)證,并利用嵌入式邏輯分析儀signal tap捕獲fpga的輸入輸出信號(hào),這里以應(yīng)用程序向ip核寫入發(fā)送數(shù)據(jù)32位“1”為例,如圖6可知,ip核的輸出符合arinc429信號(hào)標(biāo)準(zhǔn),功能配置和狀態(tài)查詢寄存器全部工作正常。 基于eda技術(shù)實(shí)現(xiàn)的arinc429總線ip核在功能上不僅可完全取代專用芯片,還加入了更符合實(shí)際應(yīng)用的單次或循

hi-8585替代型號(hào)

HI3-DAC85V-9 HI3-DAC80V-7 HI3515 HI3512RBCV100 HI3512 HI3511 HI3510 HI3103 HI3102 HI3-0201-5

HIC1015 HIC1016 HIC1026A HIGH4 HIH-3602-A HIH-3602-C HIH-3602-L HIH3610 HIH-3610-003 HIH4000

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