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當(dāng)前位置:維庫(kù)電子市場(chǎng)網(wǎng)>IC>ds90c032 更新時(shí)間:2026-03-05 04:02:40

ds90c032供應(yīng)商優(yōu)質(zhì)現(xiàn)貨

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ds90c032價(jià)格行情

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ds90c032中文資料

  • 一種實(shí)現(xiàn)MPEG2傳輸流碼率調(diào)整的方法

    2.2。2 控制電路 cpld使用lattice公司的ispmach4512v,它具有512個(gè)宏單元,最大工作頻率為400mhz,而且功耗極低。在這里cpld主要有以下幾個(gè)功能。 1)通過(guò)cy7b933的輸出信號(hào)rdy和sc/d控制數(shù)據(jù)寫入fifo,當(dāng)輸出是數(shù)據(jù)時(shí),將數(shù)據(jù)寫入fifo,如果是特殊字符,停止寫入fifo。這樣,通過(guò)寫fifo刪除特殊字符。spi接口的ts流采用低壓差分信號(hào)(lvds)電平傳輸,需要將lvds電平轉(zhuǎn)換為ttl電平,這里采用ds90c032,可將4路差分信號(hào)轉(zhuǎn)換為ttl電平信號(hào)。ds90c031將調(diào)整后的t5流由ttl電平轉(zhuǎn)化為lvds電平。spi接口輸出的t5流是連續(xù)的,通過(guò)cpld可以將數(shù)據(jù)直接寫入fifo。 2)控制ad9850的輸出時(shí)鐘,采用串行設(shè)置方式對(duì)輸出時(shí)鐘進(jìn)行設(shè)置,以便少用。 3)控制fifo的讀出及空包的插入,流程如圖2所示,主要由兩個(gè)狀態(tài)機(jī)完成。狀態(tài)機(jī)l控制湊fifo,狀態(tài)機(jī)2對(duì)讀出的數(shù)據(jù)進(jìn)行處理,建立同步。狀態(tài)機(jī)l首先監(jiān)測(cè)fifo的半滿信號(hào),如果未到半滿,則由cpl

  • DVB-C機(jī)頂盒信源解碼器的設(shè)計(jì)與實(shí)現(xiàn)

    外圍接口子系統(tǒng) 該信源解碼器集成了一個(gè)ata硬盤接口,如圖3所示。用戶可以通過(guò)此接口實(shí)現(xiàn)個(gè)人數(shù)字錄像機(jī)pvr(personal video recorder)功能;還可在硬盤中開(kāi)設(shè)海量緩存區(qū),在播放數(shù)字電視的同時(shí),對(duì)節(jié)目進(jìn)行長(zhǎng)達(dá)數(shù)小時(shí)的實(shí)時(shí)存儲(chǔ)。依賴這種緩存技術(shù),用戶可以進(jìn)行時(shí)移播放。 該解碼器擁有一個(gè)tda8004t智能卡接口和符合ieee 1149.1標(biāo)準(zhǔn)的jtag模塊,提供了基本的調(diào)試功能,還提供了lvds接口,用來(lái)接收碼流發(fā)生器輸出的ts流。由db-25接口輸入的lvds信號(hào)通過(guò)3片ds90c032進(jìn)行電平變換后,進(jìn)入解碼器。此外,該系統(tǒng)還使用了一個(gè)uart,用于機(jī)頂盒的調(diào)試和軟件升級(jí)。 圖4 機(jī)頂盒軟件分層框架 軟件設(shè)計(jì) 軟件系統(tǒng)基于一個(gè)分層的框架,其中,部分由lsi logic在其參考軟件中提供,其它部分需要由用戶自行開(kāi)發(fā)。軟件的整體結(jié)構(gòu)如圖4所示。 實(shí)時(shí)操作系統(tǒng)層(rtos)是所有上層程序代碼運(yùn)行的基礎(chǔ),主要負(fù)責(zé)多任務(wù)調(diào)度、系統(tǒng)資源管理、中斷處理、通信操作和同步處理等。本文使用的是windriver公司專門為嵌入式系統(tǒng)設(shè)計(jì)和開(kāi)發(fā)的一個(gè)模塊化、高性能的實(shí)時(shí)操作系統(tǒng)psos

  • DVB-C 機(jī)頂盒信源解碼器的設(shè)計(jì)與實(shí)現(xiàn)

    器集成了一個(gè)ata硬盤接口,如圖3所示。用戶可以通過(guò)此接口實(shí)現(xiàn)個(gè)人數(shù)字錄像機(jī)pvr(personal video recorder)功能;還可在硬盤中開(kāi)設(shè)海量緩存區(qū),在播放數(shù)字電視的同時(shí),對(duì)節(jié)目進(jìn)行長(zhǎng)達(dá)數(shù)小時(shí)的實(shí)時(shí)存儲(chǔ)。依賴這種緩存技術(shù),用戶可以進(jìn)行時(shí)移播放。 該解碼器擁有一個(gè)tda8004t智能卡接口和符合ieee 1149.1標(biāo)準(zhǔn)的jtag模塊,提供了基本的調(diào)試功能,還提供了lvds 接口,用來(lái)接收碼流發(fā)生器輸出的ts 流。由db-25 接口輸入的lvds 信號(hào)通過(guò)3 片ds90c032進(jìn)行電平變換后,進(jìn)入解碼器。此外,該系統(tǒng)還使用了一個(gè)uart,用于機(jī)頂盒的調(diào)試和軟件升級(jí)。 軟件設(shè)計(jì) 軟件系統(tǒng)基于一個(gè)分層的框架,其中,部分由lsi logic在其參考軟件中提供,其它部分需要由用戶自行開(kāi)發(fā)。軟件的整體結(jié)構(gòu)如圖4 所示。 實(shí)時(shí)操作系統(tǒng)層(rtos)是所有上層程序代碼運(yùn)行的基礎(chǔ),主要負(fù)責(zé)多任務(wù)調(diào)度、系統(tǒng)資源管理、中斷處理、通信操作和同步處理等。本文使用的是windriver 公司專門為嵌入式系統(tǒng)設(shè)計(jì)和開(kāi)發(fā)的一個(gè)模塊化、高性能的實(shí)時(shí)操作系

  • LVDS信號(hào)原理和設(shè)計(jì)( 完)

    低電流驅(qū)動(dòng)輸出實(shí)現(xiàn)了低噪聲和低功耗。ieee在兩個(gè)標(biāo)準(zhǔn)中對(duì)lvds信號(hào)進(jìn)行了定義。ansi/tia/eia-644中,推薦最大速率為655mbps,理論極限速率為1.923mbps。1.1 lvds信號(hào)傳輸組成lvds信號(hào)傳輸一般由三部分組成:差分信號(hào)發(fā)送器,差分信號(hào)互聯(lián)器,差分信號(hào)接收器。差分信號(hào)發(fā)送器:將非平衡傳輸?shù)膖tl信號(hào)轉(zhuǎn)換成平衡傳輸?shù)膌vds信號(hào)。通常由一個(gè)ic來(lái)完成,如:ds90c031差分信號(hào)接收器:將平衡傳輸?shù)膌vds信號(hào)轉(zhuǎn)換成非平衡傳輸?shù)膖tl信號(hào)。通常由一個(gè)ic來(lái)完成,如:ds90c032差分信號(hào)互聯(lián)器:包括聯(lián)接線(電纜或者pcb走線),終端匹配電阻。按照ieee規(guī)定,電阻為100歐。我們通常選擇為100,120歐。1.2 lvds信號(hào)電平特性lvds物理接口使用1.2v偏置電壓作為基準(zhǔn),提供大約400mv擺幅。lvds驅(qū)動(dòng)器由一個(gè)驅(qū)動(dòng)差分線對(duì)的電流源組成(通常電流為3.5ma),lvds接收器具有很高的輸入阻抗,因此驅(qū)動(dòng)器輸出的電流大部分都流過(guò)100ω 的匹配電阻,并在接收器的輸入端產(chǎn)生大約350mv 的電壓。電流源為恒流特性,終端電阻在100――120歐姆之間,則電壓擺動(dòng)幅度

ds90c032替代型號(hào)

DS90C031TMX DS90C031 DS9098P DS9097U-S09 DS9097U-E25 DS9097U-009 DS9097U DS9097 DS9092R DS89C450

DS90C124 DS90C241 DS90C31B DS90C363 DS90C383 DS90C383MTD DS90C385 DS90C387 DS90C402 DS90CF363

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