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SOP14/10+
只做原裝歡迎監(jiān)督
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TSSOP14/2023+
原裝現(xiàn)貨 假一罰十
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N/A/25+
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Universal Serial Bus Transceiver
FAIRCHILD
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Universal Serial Bus Transceiver
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Universal Serial Bus Transceiver
FAIRCHILD [Fairchild Semiconductor]
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Universal Serial Bus Transceiver
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1/1 Transceiver Half USB 1.1 14-SOIC
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Universal Serial Bus Transceiver
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characteristics driving high(pg 126 usb 2.0 specification) 由于信號(hào)引腳的特征輸出阻抗實(shí)際上比正確匹配負(fù)載所需的總體阻抗小很多，所以必須在這些引腳上串接電阻。許多收發(fā)器供應(yīng)商建議串接電阻阻抗為33ω。而實(shí)際上，上拉電阻阻值只要能保證傳輸線一側(cè)測(cè)出的總阻抗在28-44ω范圍內(nèi)就可以(參見圖3)。 figure 3 串聯(lián)端接電阻的不同是由于設(shè)備輸出驅(qū)動(dòng)電路阻抗特征曲線的差異，這是收發(fā)器供應(yīng)商所選擇的工藝和設(shè)計(jì)技術(shù)不同而引起的。例如，usb1t11a的外部串接電阻應(yīng)為24ω，才能使其等效輸出阻抗處于該變化范圍內(nèi)，而usb1t1102則需要33ω。特征曲線保持在圖1和圖2所示的灰色區(qū)域內(nèi)，就可保證接收端收發(fā)器所要求的vih電平得以滿足，并獲得清晰的眼圖 (eye diagram)。圖4所示為正確的眼圖示例。 figure 4 在了解正確端接與傳輸線相對(duì)的信號(hào)線方法后，還需要知道如何根據(jù)收發(fā)器在其系統(tǒng)位置作出適當(dāng)配置。首先，必須確定設(shè)備對(duì)于主機(jī)是處于上行還是下行位置。簡(jiǎn)言之，主機(jī)側(cè)的收發(fā)器為下行位設(shè)備，而外設(shè)側(cè)則為上行位設(shè)備。最簡(jiǎn)單的判斷
符合通用串行總線規(guī)范1.1；利用數(shù)字化的輸入和輸出來傳輸和接收USB數(shù)據(jù)；支持12Mbit/s“高速”，1.5Mbit/s“低速”串行數(shù)據(jù)傳輸，兼容VHDL“串行接口引擎”；支持單端數(shù)據(jù)接口；3.3V電源
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