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高性能數(shù)字音頻傳輸系統(tǒng)的設(shè)計與實現(xiàn)
具體場合及傳輸距離來選用。圖1 數(shù)字音頻傳輸系統(tǒng)原理框圖。發(fā)送端主要是完成對信號的接入、a /d 轉(zhuǎn)換、格式編碼、時鐘產(chǎn)生等工作。為了增加信號的動態(tài)范圍，同時防止a /d轉(zhuǎn)換中出現(xiàn)混疊失真，在模擬輸入通道中應(yīng)設(shè)置信號調(diào)理電路和抗混疊濾波器。接收端主要是完成對aes/ebu 格式數(shù)據(jù)的接收、解碼，恢復(fù)出主時鐘信號、同步信號，再對音頻數(shù)據(jù)進行d /a轉(zhuǎn)換等工作。 3. 2 發(fā)送端電路設(shè)計根據(jù)前節(jié)所述的系統(tǒng)方案，我們選用cirrus logic公司的cs5381和cs8406分別完成模擬信號的a /d轉(zhuǎn)換和aes/ebu格式編碼發(fā)送，電路原理如圖2 所示。圖2 發(fā)送端原理圖。 cs5381是cirruslogic公司推出120 db、192 khz高性能24 bit立體聲模數(shù)轉(zhuǎn)換芯片。cs5381可工作在主、從兩種模式下。模式選擇可通過管腳2 (m /s)來進行，本設(shè)計工作在主模式。cs5381采樣率可以通過md iv、m0和m1這3個管腳邏輯電平控制，主時鐘選擇可以根據(jù)所選的采樣頻率和md iv引腳作選擇。本設(shè)計中選擇的是48 khz單倍速采樣率，采

CS8406
完善的EIAJCP1201，IEC-60958，AES3，S/PDIF兼容發(fā)射器；＋3.3V或5.0V數(shù)字電源(VD)；＋3.3V或5.0V數(shù)字接口(VD)；片上通道狀態(tài)和用戶位緩沖存儲允許塊大小升級；靈活的3線串行數(shù)字音頻輸入端口；高達192kHz幀率；片上差動線路驅(qū)動器；產(chǎn)生CRC碼和奇偶位；獨立式模式允許不使用微控制器

AES/EBU信號選擇問題
不解碼應(yīng)該可以不解碼應(yīng)該可以，只不過切換后接收端有一陣子不同步而已，只用數(shù)字多路開關(guān)可能不行，因為要將輸入的aes信號先變成ttl信號后再轉(zhuǎn)換成aes信號輸出（用變壓器和rs422收發(fā)），僅用數(shù)字多路開關(guān)不能對輸入的aes信號（2-7vpp）進行切換。如果要對aes解碼的話，可以用fpga來實現(xiàn)或者使用cs8416和cs8406來實現(xiàn)aes信號的解碼和編碼工作，你可以查一下這兩個芯片的資料，不過，如果是做課題的話，我建議還是用fpga來提高一下自己我的email：dmqzh@yahoo.com.cn

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