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儀器測量中靈敏度/分辨率的挑戰(zhàn)
持人們熟知的windows操作系統(tǒng)所特有的點－擊、剪切－粘貼和拖－放功能。這些系統(tǒng)功能可以縮短學習曲線，從而讓測試的建立、執(zhí)行和分析在時間上更富有效率。第三個測試方面的挑戰(zhàn)是靈敏度和分辨率。儀器的靈敏度一般是由其最低的測量范圍除以分辨率來量度的。分辨率是可以觀察到的信號的最小比例。圖1所示的曲線證明了這一指標的重要意義，圖中示出了納米級金屬－氧化物半導(dǎo)體場效應(yīng)晶體管（mosfet）的柵極漏電流的測量結(jié)果。所測量到的電流的范圍從30fa變化到約170fa。這一測量需要的電流靈敏100aa（100e－18a）。無論何種情況，所要求的靈敏度都取決于應(yīng)用。圖1：納米mosfet的柵極漏電流范圍是30fa至約170fa
基于IP模塊的PCI接口設(shè)計及FPGA實現(xiàn)
境下的仿真驗證；altera的pci core為ahdl格式，通過acf文件提供布局布線時的約束，其用戶側(cè)的信號數(shù)量較少，功能簡單，便于實現(xiàn)；actel及quicklogic公司的反熔絲結(jié)構(gòu)，使其可編程芯片在速度與性能上有一定的優(yōu)勢，但pci核的功能則相對較弱。根據(jù)voip、cdma等先進的通訊系統(tǒng)對pci總線接口的實際需求，我們通過評估比較，決定采用altera公司的64位66mhz pci core，在veribest及maxplusii nt設(shè)計平臺上，針對目標器件flex10k 100e，利用vhdl硬件描述語言，設(shè)計了pci總線到摩托羅拉cpu的fpga橋接芯片。該芯片介于pci總線與摩托羅拉cpu之間，提供兩種總線間的地址轉(zhuǎn)換，命令譯碼，數(shù)據(jù)緩沖與傳輸，即插即用的配置，為系統(tǒng)的高速數(shù)據(jù)傳輸提供無縫的接口。 1．設(shè)計輸入設(shè)計輸入包括vhdl代碼設(shè)計及功能仿真。在進行設(shè)計之前，先對系統(tǒng)劃分功能模塊，最頂層例化兩個模塊：altera的pci core和用戶側(cè)邏輯。用戶側(cè)邏輯根據(jù)功能再進一步細化。vhdl的結(jié)構(gòu)化特點非常便于層次化設(shè)計，每個工程師負責完成功能相對獨立的各子
淺談射頻電容ESR的選用及應(yīng)用
有采取措施降低損耗，成象分辨率就會降低。atc100系列陶瓷電容組具有超低損耗，因而經(jīng)常用于線圈電路。這些電容組在諧振電路中發(fā)揮功能，卻不增加整個線路的損耗。 1. esr引起的電容功率耗散 esr乘以射頻網(wǎng)絡(luò)電流的平方就得到耗散在電容里的功率。所以耗散在電容里的功率可以表示為：pd=esrx(射頻電流)2或pd=esr x i2一個有趣的現(xiàn)象是，低損耗電容用于高射頻功率設(shè)備中時，設(shè)備功率可以是電容額定功率的幾百倍。下面是低esr電容這樣使用的一例。射頻功率＝1000瓦電容是atc100e102 （1000pf）頻率＝30mhzesr＝0.018 歐姆（18 毫歐姆）；設(shè)備線路阻抗＝50 歐姆。注意，100e系列最大允許功率耗散是大約5瓦。解：計算這一線路的射頻電流，再以電流計算電容中的射頻功率耗散。電流＝（功率/阻抗） 1/2 (這是這一線路內(nèi)的電流)（1000/50）1/2 =4.47 安培電容中實際耗散功率：p＝i2 x esr (這是電容將耗散的功率)p＝4.47 x 4.47 x 0.018 = 0.34 瓦。這個結(jié)果意味著在一個1000瓦

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