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[原創(chuàng)]公布DM642EVM的PCB

作者：DSP探路者　欄目：DSP技術(shù)

[原創(chuàng)]公布DM642EVM的PCB
DIY自己的DM642EVM的下文

現(xiàn)在公布DM642EVM的PCB圖片

絲印層：
../uploadfile/200705142126116643.jpg

2樓：	>>參與討論
作者： DSP探路者于 2006/12/20 22:51:00 發(fā)布：續(xù)上文，謝謝各位大俠的一路支持！頂層 ../uploadfile/200705142126124230.jpg

3樓：	>>參與討論
作者： DSP探路者于 2006/12/20 22:56:00 發(fā)布：續(xù)上文底層 ../uploadfile/200705142126142041.jpg

4樓：	>>參與討論
作者： DSP探路者于 2006/12/20 22:57:00 發(fā)布：續(xù)上文所有層 ../uploadfile/200705142126172297.jpg

5樓：	>>參與討論
作者： DSP探路者于 2006/12/20 22:58:00 發(fā)布：續(xù)上文局部圖，DM642附近 ../uploadfile/200705142126199451.jpg

6樓：	>>參與討論
作者： DSP探路者于 2006/12/20 23:00:00 發(fā)布：續(xù)上文局部，視頻AD SAA7115H附近 ../uploadfile/200705142126214908.jpg

7樓：	>>參與討論
作者： DSP探路者于 2006/12/20 23:01:00 發(fā)布：續(xù)上文局部，視頻DA SAA7105附近 ../uploadfile/200705142126238549.jpg

8樓：

>>參與討論

作者： DSP探路者于 2006/12/20 23:02:00 發(fā)布：

續(xù)上文
局部，高速電路的SDRAM附近，等長布線

* - 本貼最后修改時間：2006-12-20 23:03:50 修改者：DSP探路者

9樓：	>>參與討論
作者： cruise 于 2006/12/20 23:05:00 發(fā)布：不錯樓主加油！

10樓：

>>參與討論

作者： DSP探路者于 2006/12/20 23:09:00 發(fā)布：

感謝支持我的各路大俠
感謝網(wǎng)友：

楊工、chelonkjld、kreate、mymaymy、jackwangji、tjsheep、shicong、wyd_hua、boy364、ali06、xwj、愛喝白開水、robdm、wszqw、shaoyintai、wenming、dm641、ljianfox
還有剛才回復(fù)的cruise

的回復(fù)和討論！

你的回帖是對我工作的最好支持！

PCB設(shè)計經(jīng)過仔細(xì)檢查，沒有發(fā)現(xiàn)問題，現(xiàn)已送出制版，希望一次成功！

論壇限制上傳文件300K，沒有辦法上傳更清楚的圖！

* - 本貼最后修改時間：2006-12-20 23:13:09 修改者：DSP探路者

11樓：	>>參與討論
作者： suntan_06 于 2006/12/21 19:56:00 發(fā)布：大方又實用還沒有設(shè)計過BGA封裝的電路，很想試試。總算見到同事說的：等長布線。相當(dāng)不錯。

12樓：	>>參與討論
作者： xwj 于 2006/12/21 20:08:00 發(fā)布：好！等你調(diào)試好了給我留一塊啊大家共同學(xué)習(xí)！呵呵~~~

13樓：	>>參與討論
作者： fredu 于 2006/12/21 20:32:00 發(fā)布：高人啊以前看到這樣的板子，都覺得不可思議。今天見識了！

14樓：	>>參與討論
作者： zq_dsp 于 2006/12/21 22:55:00 發(fā)布：求教能否請樓主指教一下： 1.何謂等長布線？ 2.在布642的SDRAM時（畫PCB時），如何做到等長布線？

15樓：	>>參與討論
作者： xlander 于 2006/12/22 13:49:00 發(fā)布：很久沒看到這么強(qiáng)悍的人了

16樓：

>>參與討論

作者： DSP探路者于 2006/12/22 21:11:00 發(fā)布：

不是什么強(qiáng)人，共同探討
to xwj
沒有問題，打樣了6塊，估計板子元旦前就能回來，1月上旬就能調(diào)好，調(diào)好后給你留一塊。

email : franklejins@tom.com QQ:369171681

to zq_dsp
等長布線就是讓高速的數(shù)據(jù)、控制和時鐘信號在PCB上經(jīng)過相等的路程，保證信號的傳播時延相同，這樣可以部分地解決信號完整性問題。

不知道我說明白了沒有？

17樓：

>>參與討論

作者： shixiudong 于 2006/12/23 0:27:00 發(fā)布：

關(guān)于等長布線問題

觀點：
    DM642的EMIF數(shù)據(jù)總線，沒有必要等長布線，只要最長的那條線不至于太長就可以了。

原因：
    仔細(xì)研究EMIF的時序圖，就會發(fā)現(xiàn)，沒必要等長。我實際完成的幾個C64XX的項目，也驗證了該觀點。

建議：
    為了實現(xiàn)DM642的64根EMIF總線等長，會枉費比較大的精力，而忽視了真正關(guān)鍵的信號，導(dǎo)致系統(tǒng)不穩(wěn)定。要把精力花費在如下幾個關(guān)鍵信號，保證它們最短以及端接良好：SDRAM的CLK,DQM等控制信號線。

希望大家玩DSP玩得高興，我就是玩DSP玩出了個公司。

史修棟

18樓：

>>參與討論

作者： zq_dsp 于 2006/12/23 13:04:00 發(fā)布：

再問關(guān)于等長布線
首先感謝DSP探路者和shixiudong的耐心講解。
謝謝了。

在問幾個白白的問題：
1.“ 等長布線就是讓高速的數(shù)據(jù)、控制和時鐘信號在PCB上經(jīng)過相等的路程”這句話是否可以理解為數(shù)據(jù)線、控制和時鐘信號在PCB板上所走的長度要1mil都不差。小弟也畫過幾塊DSP的板子，所以覺得像要做到1mil都不差是不可能。是否應(yīng)該理解為所有的線中最短的和最長的差值，保證在一個范圍內(nèi)就可以認(rèn)為是等長布線，如果是，那么那個保證的差值是多大？
望賜教！
2.“要把精力花費在如下幾個關(guān)鍵信號，保證它們最短以及端接良好：SDRAM的CLK,DQM等控制信號線�！睘槭裁匆ＷC控制線的最短，是相對于數(shù)據(jù)線的最短嗎？
望賜教！

19樓：	>>參與討論
作者： zq_dsp 于 2006/12/23 13:42:00 發(fā)布：哪一貼？剛剛看到樓主的上一個帖子，“DIY自己的DM642EVM”不知道樓主以后是打算主要定哪一貼。

20樓：

>>參與討論

作者： shicong 于 2006/12/23 21:45:00 發(fā)布：

如何進(jìn)行等長走線
等長也是相對來說,并不要一樣長.假設(shè)時鐘為100MHZ，電子運行速度3*10^8m/s.
一個周期波形能走3米路，如果僅僅是在高電平或低電平有效就行，相差1.5m也應(yīng)該問題不大（不考慮成為天線的可能）。如果是上升沿，下降沿鎖定的話，就是說在這個上升的過程需要的信號必須出現(xiàn)。假設(shè)0.1ns建立，所以就是最大允許相差3cm信號不會出現(xiàn)什么問題。可以仔細(xì)看看手冊，clk都是在數(shù)據(jù)線和地址線的中間出現(xiàn)，不然的話可能就鎖住一個正在變化的數(shù)據(jù)。這是我自己的理解而已，不知道對不對？

21樓：	>>參與討論
作者：愛喝白開水于 2006/12/24 13:06:00 發(fā)布：大哥這是幾層板�。�

22樓：	>>參與討論
作者： DSP探路者于 2006/12/24 19:39:00 發(fā)布： to 愛喝白開水 6層板的干活

23樓：	>>參與討論
作者： ptmickey 于 2006/12/25 9:40:00 發(fā)布：強(qiáng)啊，都作6層板了！不知道都有什么接口

24樓：	>>參與討論
作者： catiya 于 2006/12/25 12:13:00 發(fā)布：是用的什么軟件？ POWERPCB？

25樓：	>>參與討論
作者： cyscx 于 2006/12/25 16:43:00 發(fā)布： "6層板的干活"聽起來好耳熟.... 呵呵,LZ強(qiáng)悍.....

26樓：	>>參與討論
作者： lianshumou 于 2006/12/25 22:22:00 發(fā)布：就是PowerPCB 用99SE什么的達(dá)不到這么好的效果!

27樓：	>>參與討論
作者： TXCQHBISON 于 2006/12/25 23:11:00 發(fā)布：學(xué)習(xí) 一定要象你門學(xué)習(xí)!!做一個出色的工程師!!

28樓：	>>參與討論
作者： zbh2000 于 2006/12/26 9:07:00 發(fā)布：很棒！請問樓主：你是用什么軟件畫圖？是手工，還是自動？

29樓：

>>參與討論

作者： bjwlgh 于 2006/12/26 13:22:00 發(fā)布：

我也說一下
呵呵，談一下：
（1）“等長布線就是讓高速的數(shù)據(jù)、控制和時鐘信號在PCB上經(jīng)過相等的路程，保證信號的傳播時延相同，這樣可以部分地解決信號完整性問題�！卑凑瘴业睦斫猓愕乳L布線，解決的信號時序方面的問題，并不是解決信號完整性。
（2）像SDRAM這種速率不是太高的，一般來說也沒有必要追求嚴(yán)格的等長，時鐘線相對地址，數(shù)據(jù)，控制線，控制在500MIL左右一般問題都不大。
如果實在想量化，用Cadence仿真一下，算一下時序就可以了。

30樓：	>>參與討論
作者：開發(fā)板之家于 2006/12/26 21:48:00 發(fā)布：支持一下樓主

31樓：

>>參與討論

作者： zq_dsp 于 2006/12/26 22:49:00 發(fā)布：

一個小問題
看了樓主在別的貼里發(fā)的原理圖（覺得應(yīng)該是同一塊642的板子），樓主的JTAG接口處的EMU0和EMU1，好像是直接連接到DSP上了，沒做什么處理。我畫其他系列DSP時（暫時還沒畫過642），一般這兩個腳都要有一個10K的上拉到3.3V。不然容易燒仿真器。

沒針對642芯片，做過仔細(xì)調(diào)查，如果提錯了，還望樓主海涵。

32樓：	>>參與討論
作者： yzqok 于 2006/12/27 8:22:00 發(fā)布：板子還是畫得挺好的,我也要經(jīng)常調(diào)試這種類似的板子PMP的方案.

33樓：	>>參與討論
作者： wyd_hua 于 2006/12/27 8:51:00 發(fā)布： to :zq_dsp 642這2個管腳內(nèi)部上拉30K，所以無需再外部上拉。。

34樓：	>>參與討論
作者： dsp探路者于 2006/12/27 23:12:00 發(fā)布： to shicong 電信號在pcb板內(nèi)的速度應(yīng)該是5567.72mil/ns

35樓：	>>參與討論
作者：王紫豪于 2006/12/28 16:25:00 發(fā)布：絕對支持�。�

36樓：	>>參與討論
作者：愛喝白開水于 2006/12/29 13:00:00 發(fā)布： LZ大哥請問SCH，用PROTEL怎么倒成PDF的同時把“結(jié)點”加上，怎么把 “端口” 變成“>>”，我倒過來的結(jié)點都不見了，端口和SCH中的一樣，想知道怎么倒成您那樣的、哪位大哥知道都可以指點一下，多謝～～～～

37樓：	>>參與討論
作者： DSP探路者于 2006/12/29 19:25:00 發(fā)布：用Cadence手工布線不是用99se畫的，這個軟件不太好用，雖然以前也用過

38樓：

>>參與討論

作者： aspl 于 2006/12/31 13:17:00 發(fā)布：

支持３０樓的
　　我見很多高速板的ＴＯＰ層和ＢＯＴＴＯＭ層并沒有鋪地，但是工作得很好，比如高達(dá)３Ｇ的板子，這個到底要不要鋪地呢，反正我采取的是，高頻率的ＴＯＰ不鋪．頻率低的１３３Ｍ以下的鋪地銅．
　　數(shù)據(jù)和時鐘相差在一定范圍內(nèi)等長就可以；

39樓：	>>參與討論
作者： chaijihe 于 2006/12/31 20:51:00 發(fā)布： ??? 兩層PCB就布通了？？？

40樓：	>>參與討論
作者： 008ming 于 2007/1/3 13:27:00 發(fā)布：學(xué)習(xí) 厲害呀

41樓：	>>參與討論
作者： binbinwb 于 2007/1/4 11:53:00 發(fā)布：布局不錯

42樓：	>>參與討論
作者： xfarm 于 2007/1/4 16:08:00 發(fā)布：想買一塊,不知LZ方便不?

43樓：	>>參與討論
作者： gudeng614 于 2007/1/5 12:26:00 發(fā)布：很好

44樓：	>>參與討論
作者： xuekcd832 于 2007/1/5 18:52:00 發(fā)布：厲害呀！高手

45樓：	>>參與討論
作者： xyq2001 于 2007/1/8 10:14:00 發(fā)布：向樓主學(xué)習(xí) 相信樓主布這塊版也花了不少功夫吧！真實精彩，希望日后多交流！

46樓：	>>參與討論
作者： zhomi 于 2007/1/8 17:20:00 發(fā)布： to louzhu 很不錯,加油!

47樓：	>>參與討論
作者： Orz 于 2007/1/8 20:46:00 發(fā)布：把brd和dsn文件發(fā)出來仔細(xì)瞧瞧~

48樓：	>>參與討論
作者： qiang0726 于 2007/1/9 14:21:00 發(fā)布：向高手學(xué)習(xí)

49樓：	>>參與討論
作者： ccmrose 于 2007/1/10 12:54:00 發(fā)布：如何差分布線謝謝DSP探路提供的等長布張圖，能否上傳差分布線的圖學(xué)習(xí)下，另外還想請有沒哪位朋友用走線來實現(xiàn)天線滴、能否傳個示意圖，或走線時有什么講究

50樓：	>>參與討論
作者： ql2000 于 2007/1/10 18:08:00 發(fā)布：回復(fù) 看了樓主的圖，很不錯，正在學(xué)習(xí)中�。�！

51樓：	>>參與討論
作者： Orz 于 2007/1/10 21:59:00 發(fā)布： zz * - 本貼最后修改時間：2007-1-12 8:47:29 修改者：Orz

52樓：

>>參與討論

作者： skyfighter 于 2007/1/12 13:51:00 發(fā)布：

不錯，頂一下！
學(xué)習(xí)中，看到回帖的大俠們也不少！
建議樓主在做完之后，根據(jù)大家意見觀點一直的地方做些總結(jié)！
學(xué)習(xí)中，信號的完整性和時序一致！
這種級別沒有做過，只能看看！

* - 本貼最后修改時間：2007-1-12 14:00:38 修改者：skyfighter

53樓：	>>參與討論
作者： kana 于 2007/1/12 17:40:00 發(fā)布：支持。支持呀。做完了，多多交流。

54樓：	>>參與討論
作者： lexiaozui 于 2007/1/13 10:54:00 發(fā)布：下了樓主的原理圖看,望不吝賜教~~ PDF的圖能轉(zhuǎn)換成99se的格式嗎? 因為用的99se,Cadence的SCH有些地方看不明白,TP1--TP24各連接一個圓圈請問是什么定義啊?

55樓：

>>參與討論

作者：愛喝白開水于 2007/1/13 18:47:00 發(fā)布：

LZ大哥！
問題：
1，從PCB上看，你的電源部分好象只用了2個芯片，是54310嗎？

2，怎么和原理圖不一樣？原理圖那樣的電源可以實現(xiàn)嗎？

3，原理圖中為什么A3.3和D3.3要用兩個DC/DC來實現(xiàn)，用一個DC/DC產(chǎn)生A3.3，再經(jīng)過BREAD 產(chǎn)生另個D3.3 可以嗎？

希望有人回答，多謝 ~~~！�。�

* - 本貼最后修改時間：2007-1-14 10:15:42 修改者：愛喝白開水

56樓：	>>參與討論
作者：愛喝白開水于 2007/1/15 14:27:00 發(fā)布：誰能解釋一下，感激不盡�。�！

57樓：	>>參與討論
作者： larrych 于 2007/1/17 14:29:00 發(fā)布： re re

58樓：	>>參與討論
作者： canggeng 于 2007/1/17 21:23:00 發(fā)布：都是強(qiáng)人，學(xué)習(xí)。。。

59樓：	>>參與討論
作者： yybb526526 于 2007/1/17 22:04:00 發(fā)布：跪求PCB 樓主，俺也想向你要塊PCB玩玩。QQ25364717

60樓：	>>參與討論
作者： lexiaozui 于 2007/1/19 23:36:00 發(fā)布：望能給一個DM642的PCB封裝我正在參與一個網(wǎng)絡(luò)視頻應(yīng)用項目想找一個DM642的99SE PCB封裝樓主或其他各位大俠有的話請不辭辛勞發(fā)一個給我,感激不盡! 郵箱: kuailexiaozui@163.com

61樓：	>>參與討論
作者： yzcdl 于 2007/1/24 0:16:00 發(fā)布：牛人，絕對的牛人，自己開發(fā)的東東，佩服！

62樓：	>>參與討論
作者： zhiboxie 于 2007/1/24 19:25:00 發(fā)布：非常想要DM642的板子樓主，你好。我現(xiàn)在正在做一個視頻壓縮項目，急需一塊這樣的板子，你調(diào)試后的板子能否賣我一塊？我的QQ：251416079，

63樓：

>>參與討論

作者： dsp壓路機(jī) 于 2007/1/25 19:00:00 發(fā)布：

to ccmrose
關(guān)于如何布差分電路圖,建議ccmrose朋友去XILINX網(wǎng)站上去找一找,我很久以前看過XILINX的相關(guān)文檔,里面有些很好的說明和一些示范圖片,應(yīng)該很有幫助.
因為差分線對中的電流方向正好相反,即如果DIFF+的電流方向是從A到B,那么DIFF-的電流就是從B到A,即恰好形成一個電流回路.因此兩個線要盡量貼近.

64樓：

>>參與討論

作者： sushangwen 于 2007/1/26 15:59:00 發(fā)布：

樓主的板子畫的不錯，頂
關(guān)于走線等長的問題，我支持史修棟版主的意見。

重點是關(guān)鍵信號一定要控制好走線。其他的各個數(shù)據(jù)間和地址線沒什么必要窮究。SRAM,DDRAM工作主要靠CLK等信號控制線的信號完整性保證工作正常，只要在CLK邊沿，保證數(shù)據(jù)和地址線建立時間和保持時間就可以正常工作。
一般數(shù)據(jù)和地址線的數(shù)據(jù)時間裕度很大，只要整板長度差距不超過5－10厘米，走幾十M的速率工作沒問題。

影響ESI更大的是走線端接匹配和特性阻抗，這個走線時一定要控制好，否則信號在CLK關(guān)鍵沿的時間段會變的很難看，不能保證TSU,TH時間。

65樓：	>>參與討論
作者： fpgafans 于 2007/1/27 9:53:00 發(fā)布：感謝shicong,DSP探路者樓上的貼子讓我受益很多,也請問,所謂"蛇型走線"也是為了"等長步線"的目的么?

66樓：	>>參與討論
作者： savage 于 2007/1/28 16:37:00 發(fā)布：信號在電路板上的速度比光速慢多了大概只有1/6～1/3的光速，具體數(shù)據(jù)不記得了，還要根據(jù)PCB的介電常數(shù)算。

67樓：	>>參與討論
作者： dajun 于 2007/1/28 18:09:00 發(fā)布：這么好的帖子可得好好頂一下

68樓：	>>參與討論
作者： DSP探路者于 2007/2/1 23:02:00 發(fā)布：電場在電路板中的速度確實遠(yuǎn)遠(yuǎn)小于光速主要是由于傳播媒質(zhì)的介電常數(shù)大于真空的介電常數(shù)

69樓：	>>參與討論
作者： nffydjh 于 2007/2/5 18:42:00 發(fā)布：請問各位大俠，PADS里DM642的原理圖封裝怎么得到啊請問各位大俠，PADS里DM642的原理圖封裝怎么得到啊

70樓：	>>參與討論
作者： lxfcys 于 2007/3/6 13:05:00 發(fā)布：用PROTEL DXP畫的DM642-PCB

71樓：	>>參與討論
作者： lxfcys 于 2007/3/6 13:07:00 發(fā)布：用PROTEL DXP畫的DM6446-PCB 手動布線

72樓：	>>參與討論
作者： DSP探路者于 2007/3/7 23:13:00 發(fā)布： lxfcys的板子做的漂亮是不是自己做的？佩服！能否留下聯(lián)系方式，郵箱、QQ、MSN都可以，現(xiàn)在正關(guān)注DaVinci系列！

73樓：	>>參與討論
作者： DSP探路者于 2007/3/13 21:24:00 發(fā)布：將DIY進(jìn)行到底下一步準(zhǔn)備研究Davinci

74樓：	>>參與討論
作者： hotpower 于 2007/3/13 21:53:00 發(fā)布：可憐菜農(nóng)沒銀子玩6系列~~~28系列也泡湯了~~~

75樓：	>>參與討論
作者： revgen 于 2007/3/14 14:05:00 發(fā)布：怎樣焊接？ 72 73樓的兩塊板子上主要芯片旁都沒看到有MARK點，請問在焊接時是用什么定位芯片的？如果有工藝邊的話，在上面做MARK點，能保證中心的芯片定位的準(zhǔn)確性嗎？

76樓：	>>參與討論
作者： wsldc 于 2007/3/20 19:29:00 發(fā)布：向各位大哥學(xué)習(xí) 你們太厲害了，我是初學(xué)，多多指教！

77樓：	>>參與討論
作者： whehong 于 2007/4/16 20:35:00 發(fā)布：佩服樓主真是強(qiáng)�。∨宸�！佩服！

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