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各位請教個非門的問題

作者:hedy007 欄目:技術(shù)交流
各位請教個非門的問題
如圖:用一個非門做個防抖動電路:在按鍵S3未按下時,U7 2端輸出高電平,按下時出現(xiàn)低電平現(xiàn)在出現(xiàn)的問題是只要將1端接入后,即使鍵未按下,測量1段電壓就有1.5V多,2段就輸出低。如果不接非門R56上端就為0V點。這是為什么?

2樓: >>參與討論
hedy007
各位高手請教了
 
3樓: >>參與討論
spwp
請教個非門
去掉R54,r56端加100K上拉。

4樓: >>參與討論
hedy007
我試下:謝謝了
 
5樓: >>參與討論
hedy007
問題還是存在
 
6樓: >>參與討論
AA_55
這個畫法太不規(guī)范了
你那個s開關(guān),是按下來導(dǎo)通還是按下來斷開的?這種黑盒子式元件畫法沒發(fā)搞明白。

另外,要確定你的非門器件是不是真的是你圖紙上標的SN74LS04?如果用74HC04之類的CMOS器件,就大不同了,別看他們都是非門。

把上述問題線回答了,我看能不能分析分析

7樓: >>參與討論
maychang
LS系列芯片輸入端懸空為高電平
需要相當小的電阻才能夠拉到低電平,10k電阻太大了,應(yīng)該用1k甚至470歐,同時R54R57也要改小。
74HC0474HC14就不存在這個問題。
LS芯片屬于應(yīng)該淘汰的芯片,改用HC系列吧,價格還便宜。

8樓: >>參與討論
AA_55
maychang把話都給說了:D
TTL器件的輸入腳是內(nèi)部多發(fā)射級三極管的一個發(fā)射極。輸入如果懸空,這個懸空腳會對外出現(xiàn)一個懸空電平,大約為1.5V,這個遠大于器件的最高VIL,就等于輸入了邏輯1。如果想讓器件輸入腳反映為邏輯0,就要把內(nèi)部多發(fā)射級三極管的這個發(fā)射極的電平拉下來。

74LS04的IIL大約是0.36mA。如果想下拉輸入腳到0電平(器件規(guī)定是VIL最大不能高于0.8V),大約要接的最大電阻是0.8V/0.36mA=2.2K,顯然10k太大了,所以輸入腳被抬高,成了邏輯1。

9樓: >>參與討論
conwh
實際到單片機上的不需要非門
 
10樓: >>參與討論
hedy007
問題已經(jīng)解決就是因為R56太大了。謝謝大家
 
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