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在電路板上，芯片中未用的輸入/輸出引腳如何處理？ |
| 作者：陳懿 欄目：DSP技術(shù) |
本人第一次開發(fā)電路板，弱弱的問一個(gè)問題： 在電路板上，芯片中未用的輸入/輸出引腳如何處理？ |
| 2樓： | >>參與討論 |
| 作者： 陳懿 于 2006/10/18 15:26:00 發(fā)布：
有這種說法 我在一本書上看見這樣一種說法： “ 未用的輸入引腳不能懸空不接，而要將其上拉或下拉為固定電平 未用的輸出引腳可以懸空不接” 對嗎？ |
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| 3樓： | >>參與討論 |
| 作者： 銅錘 于 2006/10/18 20:17:00 發(fā)布：
不用的拉到低電平上阿 如上 |
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| 4樓： | >>參與討論 |
| 作者： 陳懿 于 2006/10/20 9:27:00 發(fā)布：
^_^ 哦 試試看 謝謝了 ^_^ |
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| 5樓： | >>參與討論 |
| 作者： shicong 于 2006/10/20 9:56:00 發(fā)布：
這個(gè)沒什么 開發(fā)板沒關(guān)系，空著就空著。做產(chǎn)品才考慮，功耗和影響的 |
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| 6樓： | >>參與討論 |
| 作者： tjsheep 于 2006/10/20 10:57:00 發(fā)布：
剪掉…… |
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| 7樓： | >>參與討論 |
| 作者： zms_811220 于 2006/10/20 12:43:00 發(fā)布：
我的經(jīng)驗(yàn) 同陳懿朋友的基本一致 |
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| 8樓： | >>參與討論 |
| 作者： nyj7712 于 2006/10/20 20:28:00 發(fā)布：
我的經(jīng)驗(yàn) 如果懸空，置成輸出狀態(tài)即可；如果只能是輸入口，要接上拉或下拉（看功耗）。 |
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| 9樓： | >>參與討論 |
| 作者： ehoosee 于 2006/10/22 9:07:00 發(fā)布：
輸入拉低,輸出懸空 |
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