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cpld開發(fā)板，剛下載后是正常的，斷電再上電，輸出的波形就不正常 |
| 作者：kkkkdan 欄目：MCU技術(shù) |
周立功的cpld的開發(fā)板，基于EPM7128SLC84-10 下載好后，不給開發(fā)板斷電，用示波器測量用到的io口，波形是正常的 但是給開發(fā)板斷電，再重新上電，這時(shí)候就不確定的，有時(shí)候正常，有時(shí)候不正常。 不正常的表現(xiàn)為：一個(gè)波形測不到，另一個(gè)波形是錯(cuò)誤的，當(dāng)然也有正確的波形 懷疑是下載電路出了點(diǎn)問題 誰知道怎么檢查下載電路是否有問題啊，直接測量tdo等四個(gè)io口的電壓可以嗎？ |
| 2樓： | >>參與討論 |
| 作者： zlgmcu 于 2006/8/31 8:46:00 發(fā)布：
一般下載的軟件都有個(gè)校驗(yàn)位, 把那個(gè)校驗(yàn)位勾上，如果下載不正確，他會(huì)有所提示的. |
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| 3樓： | >>參與討論 |
| 作者： kkkkdan 于 2006/9/1 12:00:00 發(fā)布：
錯(cuò)誤大概是這樣的： 比如說兩個(gè)模塊同時(shí)對同一個(gè)clk計(jì)數(shù) 第一個(gè)模塊在第一個(gè)clk的脈沖開始計(jì)數(shù) 按道理來說，第二個(gè)模塊也基本上同時(shí)對clk計(jì)數(shù) 可事實(shí)上不是的，第二個(gè)模塊開始計(jì)數(shù)的時(shí)候，clk已近過了幾個(gè)周期了 這樣，兩個(gè)模塊的輸出就沒什么關(guān)聯(lián)性了，而且結(jié)果是隨機(jī)的 只要斷電再上電，結(jié)果就跟上次不一樣了 我改了一下程序，現(xiàn)在基本上可以了。但是以前的程序也是正確的阿，都用過很長時(shí)間了，可能開發(fā)板出了點(diǎn)問題，只好修改程序來彌補(bǔ)了 |
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