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我自己做的IP CORE(用Verilog和VHDL寫的)能賣嗎? |
| 作者：4wolf 欄目：IC設計 |
我畢業(yè)論文做的 用在UMTS手機上的TURBO DECODER IP CORE, 會有人想要嗎? 優(yōu)化后的MAX-LOG-MAP加SLIDING WINDOW算法.動態(tài)截止. 工作最高頻率250MHZ. 當CODEBLOCK長度5114 Bit(MAX in 3GPP)時候. 如果設置成跌代12次,THROUGHPUT大概21Mbps. 經(jīng)驗證滿足HSDPA CATGORY 10. 綜合后約250K NAND GATE.其中包括一個INTERLEAVER的MEMORY和一個SISO的MEMORY. 不知道自己論文做出來的東西,法律上準不準個人買賣. * - 本貼最后修改時間：2006-7-21 21:43:40 修改者：4wolf |
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| 作者： greenhawka 于 2006/7/25 13:00:00 發(fā)布：
會 如果你的測試做得好，這個核應該是有人會要的 |
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| 作者： rickyice 于 2006/7/25 14:57:00 發(fā)布：
re 要有完備的文檔，建議看看synopsys的ip core |
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| 4樓： | >>參與討論 |
| 作者： nhtabs 于 2006/7/26 21:21:00 發(fā)布：
impossilbe 基本上沒有人會買，實驗室離production還有太多的工作要做， 比如 dft, coverage, verification environment, document, 特別是這種通訊算法的片子，沒有SILICON proven,沒有SUPPORT， no way |
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| 作者： 4wolf 于 2006/7/28 9:34:00 發(fā)布：
謝謝各位的回復 我的論文是在一家知名國際公司的設計驗證部門里做的,不是只為了研究而在FPGA上弄弄就結(jié)束.有相關的整套驗證程序,流程和文檔.程序和文檔部分我寫的,驗證程序95%不是我做的.但是完全順利通過驗證,已經(jīng)綜合完成送到LAYOUT部門去了.性能相關的BIT ERROR RATE 和 BLOCK ERROR RATE等 也有精確的模擬和驗證,滿足相應的要求.這個IP CORE的前一版本已經(jīng)被運用在芯片組中而且已經(jīng)投產(chǎn).現(xiàn)有的新版本是前一版本的優(yōu)化.面積稍微比原來的大一些,但是性能更強.同類性能的IP CORDE只有少數(shù)幾家公司才有. nhtabs說的對,相關涉及到的東西很多,我怎么可能獨立完成?不過確實是有.但是不能拿來這里啊,那可是要侵權的.我只是想問問有沒有人對我完成的這部分感興趣.也希望有高人能提供一下他所做的相關東西的資料. |
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| 作者： nevsaylost 于 2006/7/30 21:48:00 發(fā)布：
在法律上不能賣 首先佩服樓主很牛，在大公司工作很多年的老鳥也不一定能有機會和能力做一個完整IP出來。 從技術上說，SILICON proved的IP是可以賣的。 從市場上說，通常IP只由非常大非常專業(yè)的公司才會賣IP，因為售后維護支持等還有一系列問題。 從法律上說，這只是你在這個公司工作或?qū)嵙晻r做的一塊IP而已，你利用了公司的資源(環(huán)境、軟件和機器等)，即使與所有IP有關的工作是你一個人做的，也屬這個公司的產(chǎn)權。更何況程序(不知你的程序指什么，RTL code 嗎？)和文檔只有部分是你寫的，連驗證都不是你做的。 |
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| 7樓： | >>參與討論 |
| 作者： 東方不敗 于 2006/8/5 10:11:00 發(fā)布：
大公司不會買，小公司不愿買 |
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| 8樓： | >>參與討論 |
| 作者： jqlong 于 2006/8/14 22:01:00 發(fā)布：
可以拿來騙人 呵呵 |
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| 9樓： | >>參與討論 |
| 作者： 逗號 于 2006/8/16 23:38:00 發(fā)布：
第一個需要弄清楚的問題 聽你的描述，這個設計不是你一個人設計出來的。所以如果你想賣的話第一個要弄清楚的是這個ip的知識產(chǎn)權是不是屬于你的。 * - 本貼最后修改時間：2006-8-17 10:54:59 修改者：逗號 |
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| 10樓： | >>參與討論 |
| 作者： bearpp 于 2006/8/22 11:20:00 發(fā)布：
法律問題 首先搞清楚公司同意不同意你賣，你有沒有權利買，然后再來討論其他問題。不然會有法律問題。除非小公司要博一把的。。。。樓上的是正解 |
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