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奇怪了,FIFO出來的數(shù)據(jù)不對(duì)了 |
| 作者：yu190117 欄目：技術(shù)交流 |
用了四片IDT7205的FIFO,復(fù)位之后,給相同的寫入相同的數(shù)據(jù),讀出數(shù)據(jù)時(shí),用邏輯分析儀出來的數(shù)據(jù)卻不一樣,這是為什么?空滿設(shè)置也是對(duì)了, RT信號(hào)直接設(shè)為高電平.用的是SPARTAN II的FPGA控制的時(shí)序.希望給點(diǎn)意見.謝謝 |
| 2樓： | >>參與討論 |
| 作者： nyf1972 于 2006/5/26 23:55:00 發(fā)布：
關(guān)注中! 我的朋友正準(zhǔn)備使用IDT7205有用過的朋友多多分享! |
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| 3樓： | >>參與討論 |
| 作者： yu190117 于 2006/6/12 16:16:00 發(fā)布：
用過的說一聲唄 FIFO的輸出數(shù)據(jù)在讀信號(hào)的下降沿輸出正確的數(shù)據(jù),但是在讀信號(hào)的上升沿之前數(shù)據(jù)就已經(jīng)改變了.用過的吱一聲唄.謝謝 |
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