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關(guān)于邏輯設(shè)計(jì)工程師 |
| 作者：huahl 欄目：IC設(shè)計(jì) |
在21ic上看到一篇文章，如下： 純粹的邏輯設(shè)計(jì)工程師大部分是沒(méi)有前景的，我個(gè)人以為這部分只能是一個(gè)簡(jiǎn)單的工具。一個(gè)IC工程師如果想未來(lái)有所發(fā)展，要么向系統(tǒng)發(fā)展成為系統(tǒng)工程師性質(zhì)的技術(shù)經(jīng)理（或資深工程師），要么在后端設(shè)計(jì)有所發(fā)展成為處理全芯片tape-out性質(zhì)的技術(shù)經(jīng)理（或資深工程師），要么多積累一些ANALOG設(shè)計(jì)經(jīng)驗(yàn)成為一個(gè)資深模擬工程師。 邏輯工程師的可替換性太強(qiáng)，如果在良好的設(shè)計(jì)規(guī)范與系統(tǒng)培訓(xùn)下，一般半年就可以替換已有工程師。當(dāng)然資深邏輯工程師可能設(shè)計(jì)的邏輯部分又小又快，不過(guò)現(xiàn)在IC中邏輯部分的小和快都已經(jīng)不是問(wèn)題。大部分的問(wèn)題都在與產(chǎn)品系統(tǒng)規(guī)劃與hardblock的線(xiàn)路設(shè)計(jì)。 目前本人正在思考這個(gè)問(wèn)題，準(zhǔn)備轉(zhuǎn)型，不知道大家怎么看這個(gè)職業(yè)，又有什么好的建議？ |
| 2樓： | >>參與討論 |
| 作者： 越隆時(shí)空 于 2006/3/27 7:18:00 發(fā)布：
你的想發(fā)很不錯(cuò)?? 路還是一步步走,有了目標(biāo)我想學(xué)習(xí)就有了動(dòng)力,努力學(xué)習(xí)就是了 |
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| 3樓： | >>參與討論 |
| 作者： huahl 于 2006/3/27 11:26:00 發(fā)布：
那方向呢 現(xiàn)在比較迷惘的就是方向問(wèn)題，我到底何去何從？ 還請(qǐng)高手指教。 |
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| 4樓： | >>參與討論 |
| 作者： huahl 于 2006/3/27 19:06:00 發(fā)布：
大家?guī)臀蚁胂?br>給個(gè)建議，我現(xiàn)在都郁悶死了 |
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| 5樓： | >>參與討論 |
| 作者： y.sun 于 2006/3/27 22:18:00 發(fā)布：
還是向系統(tǒng)工程師發(fā)展吧 |
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| 6樓： | >>參與討論 |
| 作者： huahl 于 2006/3/27 22:25:00 發(fā)布：
系統(tǒng)工程師主要從事什么樣的工作呢 系統(tǒng)工程師主要從事什么樣的工作呢， 我現(xiàn)在也已經(jīng)做了很多產(chǎn)品了，這些是不是可以算是系統(tǒng)呢 |
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| 7樓： | >>參與討論 |
| 作者： huahl 于 2006/3/28 18:27:00 發(fā)布：
大家給點(diǎn)意見(jiàn)啊。。。。 期待拯救ing |
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| 8樓： | >>參與討論 |
| 作者： boris 于 2006/3/29 21:16:00 發(fā)布：
不要急，慢慢來(lái) 一般的人都不愿意做編碼工人，編碼工人的需求一直都會(huì)存在，但收入和成就感都不會(huì)很好。 接樓主的話(huà)，在編碼工人的基礎(chǔ)上發(fā)展，一個(gè)可以是向系統(tǒng)方面，另一個(gè)可以是后端或模擬方面。系統(tǒng)方面要求思維要廣博，例如算法研究。后端或模擬方面要求思維要細(xì)膩。這兩方面的思維方式有所不同，盡量根據(jù)自己的思維習(xí)慣和強(qiáng)勢(shì)來(lái)選擇。另外，機(jī)會(huì)也很重要，實(shí)戰(zhàn)中才容易增長(zhǎng)有用經(jīng)驗(yàn)。 |
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| 9樓： | >>參與討論 |
| 作者： huahl 于 2006/3/29 23:11:00 發(fā)布：
多謝boris 多謝boris 現(xiàn)在我只接觸到一點(diǎn)算法方面的東西，而且一直從事數(shù)字方面的設(shè)計(jì)，轉(zhuǎn)向系統(tǒng)和模擬估計(jì)有點(diǎn)難度，所以只有后端可以嘗試。 我現(xiàn)在做過(guò)幾個(gè)產(chǎn)品，而且是從頭到尾都經(jīng)歷過(guò)的，做后端至少不會(huì)太陌生。 最后不知道我理解的后端是否正確：就是用modsim仿真，有MAX，quaters做綜合。 期待確認(rèn)！ |
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| 10樓： | >>參與討論 |
| 作者： huahl 于 2006/3/31 17:56:00 發(fā)布：
做同步數(shù)字電路設(shè)計(jì)呢？ 我本人希望可以做仿真，fpga啊這些工作，或者就做同步數(shù)字電路設(shè)計(jì)，不知道可不可以？ |
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| 11樓： | >>參與討論 |
| 作者： boris 于 2006/3/31 20:53:00 發(fā)布：
仿真和綜合內(nèi)涵與后端的內(nèi)涵不同 “一直從事數(shù)字方面的設(shè)計(jì)”與“轉(zhuǎn)向系統(tǒng)和模擬估計(jì)有點(diǎn)難度”之間沒(méi)有很大的關(guān)聯(lián)，只要你的思維能力還在，就可以嘗試。 從你的描述中感覺(jué)，似乎你還沒(méi)有經(jīng)歷過(guò)數(shù)字ASIC設(shè)計(jì)的芯片項(xiàng)目。（你不會(huì)還是學(xué)生吧？學(xué)生階段或者剛畢業(yè)時(shí)，做做編碼工人還是很有用的）如果想熟悉后端，僅僅開(kāi)發(fā)仿真、fpga等是不夠的。數(shù)字ASIC的后端最少要包含P&R和DFT。 另外，現(xiàn)在的數(shù)字ASIC設(shè)計(jì)都是盡量采用同步電路設(shè)計(jì)，一般只有在不得已的情況下才使用異步電路設(shè)計(jì)。 |
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| 12樓： | >>參與討論 |
| 作者： huahl 于 2006/3/31 21:51:00 發(fā)布：
我說(shuō)下我自己的情況把 |
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| 13樓： | >>參與討論 |
| 作者： huahl 于 2006/3/31 21:56:00 發(fā)布：
我說(shuō)下我自己的情況把 我現(xiàn)在在一家標(biāo)榜的IC 設(shè)計(jì)公司工作，快一年了。 這個(gè)公司主要就是用畫(huà)原理圖這種老方法設(shè)計(jì)一些還不到一萬(wàn)個(gè)管子的產(chǎn)品，用的都是異步設(shè)計(jì)，綜合工具只是用來(lái)做fpga下載的。 boris現(xiàn)在還有還有什么想法嗎？ |
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| 14樓： | >>參與討論 |
| 作者： hover99 于 2006/4/2 10:20:00 發(fā)布：
關(guān)鍵在于人 數(shù)字前端設(shè)計(jì)算是創(chuàng)造性比較強(qiáng)的工作，而后端和模擬靠的更多的是知識(shí)的積累。拋開(kāi)興趣因素，如果覺(jué)得自己是主動(dòng)性的（工作的時(shí)候會(huì)主動(dòng)思考）那么做數(shù)字設(shè)計(jì)是比較合適的，如果屬于被動(dòng)性的那么做后端和模擬比較合適。 不管是數(shù)字設(shè)計(jì)還是模擬設(shè)計(jì)對(duì)工具的依賴(lài)性并不強(qiáng)，做后端基本上考EDA軟件+經(jīng)驗(yàn)。不過(guò)做后端因?yàn)镋DA軟件太貴，以及和fab的關(guān)系太密切，公司尤其是獨(dú)立的公司比較少，工作選擇的范圍比較窄。 另外，流行的說(shuō)法是：做軟件需要半年，做硬件需要1年，寫(xiě)RTL需要3年。 最后，用原理圖來(lái)設(shè)計(jì)電路（門(mén)級(jí)）并不代表落后（LATTICE做的90nm的FPGA的核心部分也是用門(mén)級(jí)設(shè)計(jì)的），對(duì)性能，功耗或成本有很高要求的電路還是需要從門(mén)級(jí)來(lái)設(shè)計(jì)，不過(guò)基本上RTL級(jí)設(shè)計(jì)是主流。 |
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| 15樓： | >>參與討論 |
| 作者： jackichen 于 2006/4/2 16:15:00 發(fā)布：
hover99不要誤導(dǎo)年輕人 模擬電路的設(shè)計(jì)不僅要靠要靠經(jīng)驗(yàn)，對(duì)創(chuàng)造性的要求一點(diǎn)都不低。大家看看ADI，LINEAR Tech，MAXIM等知名模擬IC公司的產(chǎn)品就知道了。我 一個(gè)好的后端設(shè)計(jì)師要有對(duì)微電子物理的深入理解和工藝知識(shí)，例如對(duì)Lachup和ESD危險(xiǎn)的警覺(jué)。 |
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| 16樓： | >>參與討論 |
| 作者： hover99 于 2006/4/2 22:52:00 發(fā)布：
創(chuàng)造性是相對(duì)的 我的意思是，ANALOG的創(chuàng)新要比數(shù)字難得多，除了少數(shù)天才，大部分模擬工程師所作的就是把理論上的電路映射到具體應(yīng)用中。此外，對(duì)于模擬工程師而言，主要的工作是利用自己的多年積累的經(jīng)驗(yàn)對(duì)理想電路作改造和仿真，在功耗，性能和成本方面作折衷。 我所說(shuō)的模擬和后端主要靠經(jīng)驗(yàn)的積累，其實(shí)就是知識(shí)的積累。一本寫(xiě)得比較詳細(xì)的模擬電路設(shè)計(jì)差不多可以覆蓋一個(gè)普通工程師涉及到的所有產(chǎn)品，模擬工程師需要做的將理論知識(shí)和自己的經(jīng)驗(yàn)相結(jié)合設(shè)計(jì)出符合要求的電路。而對(duì)于數(shù)字工程師而言，必須面臨設(shè)計(jì)全新電路的挑戰(zhàn)。 |
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| 17樓： | >>參與討論 |
| 作者： toqbs 于 2006/4/3 9:43:00 發(fā)布：
“邏輯設(shè)計(jì)”僅僅是一種系統(tǒng)實(shí)現(xiàn)的手段 其實(shí)，對(duì)于數(shù)字前端設(shè)計(jì)而言，“邏輯設(shè)計(jì)”僅僅是一種系統(tǒng)實(shí)現(xiàn)的工具，就像以前用板級(jí)電路實(shí)現(xiàn)一個(gè)系統(tǒng)一樣。從本質(zhì)上講，ASIC設(shè)計(jì)與板級(jí)電路設(shè)計(jì)是同一回事。之所以覺(jué)得ASIC設(shè)計(jì)顯得比較神秘，那是因?yàn)锳SIC設(shè)計(jì)在國(guó)內(nèi)起步較晚的緣故。無(wú)論是ASIC設(shè)計(jì)，還是板級(jí)電路設(shè)計(jì)，雖然做好了也并不容易，但都只是一種工具，問(wèn)題的關(guān)鍵不在于工具，而在于它所要實(shí)現(xiàn)的問(wèn)題的本身。例如設(shè)計(jì)通信IC，就必須精通通信原理，設(shè)計(jì)視頻IC，就必須精通視頻技術(shù)。在現(xiàn)實(shí)中，我們經(jīng)�？梢钥吹�，數(shù)字前端設(shè)計(jì)工程師往往不是微電子專(zhuān)業(yè)出身的。其實(shí)，數(shù)字前端設(shè)計(jì)而言，相對(duì)于通信工程、信號(hào)與信息處理、計(jì)算機(jī)體系結(jié)構(gòu)等專(zhuān)業(yè)，微電子專(zhuān)業(yè)出身者不占任何優(yōu)勢(shì)。 |
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| 18樓： | >>參與討論 |
| 作者： huahl 于 2006/4/3 23:50:00 發(fā)布：
多謝各位的金玉良言，學(xué)習(xí)了很多 |
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