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MAX+PLUS II編譯遇到問題！ |
| 作者：zxs2000 欄目：EDA技術(shù) |
MAX+PLUS II編譯遇到問題！ 編譯出現(xiàn)下面錯誤： Warning:GLOBAL primitive on node 'rd' feeds LOGIC - non -GLOBAL signal usage may result. Error:IIIegal assignment-- - GLOBAL clock 'rd' on pin 28 infno fit possible with the current DEVICE error:no fit found,generating report file 源碼為: `define key_addr 16'hff00 `define led_addr 16'hff01 `define no_rw 2'h0 `define key_rw 2'h1 `define led_rw 2'h2 MODULE key_led(MCU_data,MCU_address,keyin,led,int,wr,rd,ale); input[7:0]MCU_address; inout[7:0]MCU_data; input[7:0]keyin; OUTPUT[7:0]led; OUTPUT int; input wr; input rd; input ale; reg[1:0]addr_sel; reg[7:0]led_reg; reg[7:0]MCU_data_reg; reg[7:0]key_status; reg int_reg; always@(negedge ale) begin if({MCU_address,MCU_data}==`key_addr) addr_sel = `key_rw; else if({MCU_address,MCU_data}==`led_addr) addr_sel = `led_rw; else addr_sel = `no_rw; end always@(keyin) begin if(keyin == key_status) int_reg=1; else int_reg=0; end always@(negedge wr) begin if(addr_sel == `led_rw) led_reg = MCU_data; end always@(negedge rd) begin if(addr_sel == `led_rw) MCU_data_reg = led_reg; else if(addr_sel == `key_rw) begin MCU_data_reg=keyin; key_status=keyin; end end assign MCU_data=((rd==1'b1)||(addr_sel==`no_rw))?8'hz:MCU_data_reg; assign led=led_reg; assign int=int_reg; endMODULE 使用的芯片為：EPM7128SLC84-15 腳位分配：MCU_data[7:0] ={4,5,6,8,9,10,11,12} MCU_address[7:0]={15,16,17,18,20,21,22,24} led[7:0]={30,31,33,34,35,36,37,39 } keyin[7:0]={56,57,58,60,61,63,64,65} ale -----25 wr-------27 rd -------28 int --------29 |
| 2樓： | >>參與討論 |
| 作者： 鑫超 于 2006/3/11 18:03:00 發(fā)布：
我 很難呀 |
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