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請(qǐng)問(wèn)PLL倍頻芯片有沒(méi)有精度問(wèn)題？比如ICS502 |
| 作者：zwcwy 欄目：技術(shù)交流 |
用倍頻芯片把10MHZ倍頻到40MHZ,輸出頻率是否絕對(duì)準(zhǔn)確（假設(shè)輸入頻率絕對(duì)準(zhǔn)確的前提下）？還是會(huì)有一定的偏差？芯片上的參數(shù)中只有抖動(dòng)的參數(shù)，如何理解？ * - 本貼最后修改時(shí)間：2006-2-15 17:42:49 修改者：zwcwy |
| 2樓： | >>參與討論 |
| 作者： 赤鑄 于 2006/2/16 0:22:00 發(fā)布：
一般只考慮相位噪聲（抖動(dòng)） PLL中包含積分環(huán)節(jié)，理論上是沒(méi)有靜差的，所以只考慮動(dòng)態(tài)的誤差和噪聲 |
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| 3樓： | >>參與討論 |
| 作者： zwcwy 于 2006/2/16 11:57:00 發(fā)布：
實(shí)際的積分器會(huì)有失調(diào)吧 我輸入的信號(hào)是一個(gè)上千元的振蕩器（準(zhǔn)確度10的－8次方），希望倍頻后仍能保證這個(gè)準(zhǔn)確度級(jí)別（相位同步?jīng)]有嚴(yán)格要求），估計(jì)能否保證？另外使用FPGA中的PLL與使用獨(dú)立的PLL芯片性能上有何大的區(qū)別嗎？ |
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| 作者： hidaicy 于 2006/3/2 23:10:00 發(fā)布：
有點(diǎn)區(qū)別 倍頻后相噪會(huì)呈指數(shù)增長(zhǎng)，fpga好像最小輸入頻率為16M多！��！ |
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