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請(qǐng)教幾種HDL的語(yǔ)言區(qū)別,選擇哪們比較好? |
| 作者：kjsong 欄目：模擬技術(shù) |
我原來(lái)是學(xué)軟的,現(xiàn)在想轉(zhuǎn)向硬件方面,請(qǐng)教各位大俠我選擇哪門(mén)語(yǔ)言比較好?小弟在這里先謝了! |
| 2樓： | >>參與討論 |
| 作者： xiaoxu_79 于 2006/1/24 11:01:00 發(fā)布：
vhdl！ 各有利弊吧！ |
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| 3樓： | >>參與討論 |
| 作者： zcs_1 于 2006/1/24 11:12:00 發(fā)布：
就學(xué)verilog 吧 簡(jiǎn)單，用的人也很多 |
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| 4樓： | >>參與討論 |
| 作者： kjsong 于 2006/1/24 13:41:00 發(fā)布：
謝謝! 謝謝兩位大俠的幫助!我還希望得到更多詳細(xì)的信息. |
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| 5樓： | >>參與討論 |
| 作者： cl14145696 于 2006/1/24 14:53:00 發(fā)布：
vhdl 有發(fā)展的說(shuō)不定還有機(jī)會(huì)合作呢？ |
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| 6樓： | >>參與討論 |
| 作者： dtg_1976 于 2006/2/8 13:47:00 發(fā)布：
vhdl vhdl |
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| 7樓： | >>參與討論 |
| 作者： blueprince 于 2006/2/8 14:58:00 發(fā)布：
re 轉(zhuǎn)高人給的建議： verilog適合初學(xué)者，接近c(diǎn)，適合初學(xué)。 vhdl有很多的經(jīng)典的例子，適合后來(lái)讀讀汲取。 |
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| 8樓： | >>參與討論 |
| 作者： tfeng 于 2006/2/9 9:18:00 發(fā)布：
各有千秋! 兩種語(yǔ)言各有各的長(zhǎng)處.歐洲的公司普遍習(xí)慣用VHDL,而美國(guó)的公司習(xí)慣用verilog.還要具體看你做什么了.像如果做IC設(shè)計(jì)的話就用verilog的比較多.而我們公司做FPGA都用VHDL.但不管怎樣都是要精通一門(mén)的同時(shí)也會(huì)另一門(mén).至少要能看懂.這是我自己的體會(huì),僅供參考. |
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