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請教：FPGA的VCCIO接3.3V,在閑置的IO口輸出高電平時卻為5V電壓？ |
| 作者：xiesc2004 欄目：技術(shù)交流 |
電源電壓為5V,FPGA的nSTATUS,FP_CONFIG,DATA0,CONF_DONE,通過上拉電阻接到5V; VCCIO接3.3V,VCCINT接2.5V,為什么在閑置的IO口輸出高電平時卻為5V電壓？ |
| 2樓： | >>參與討論 |
| 作者： yadog 于 2006/1/18 13:33:00 發(fā)布：
re 要看什么型號的撒 datasheet上有說把 |
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