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Protel軟件的最新高端版本Altium Designer 6.0 已經(jīng)出來了,ARM7 |
| 作者：bernardliu 欄目：ARM技術(shù) |
Protel軟件的最新高端版本Altium Designer 6.0 已經(jīng)出來了,支持ARM7 在嵌入式設(shè)計部分，增強了JTAG器件的實時顯示功能，增強型基于FPGA的邏輯分析儀，可以支持32位或64位的信號輸入。增強了對更多的32位微處理器的支持，可以使嵌入式軟件設(shè)計在軟處理器，F(xiàn)PGA內(nèi)部嵌入的硬處理器，分立處理器之間無縫的遷移。使用了Wisgbone 開放總線連接器允許在FPGA上實現(xiàn)的邏輯模塊可以透明的連接到各種處理器上。 Altium Designer 6.0支持 XILINX MicroBlaze，TSK3000 等32位軟處理器，PowerPC 405 硬核，并且支持AMCC 405和SHARP BlueStreak ARM7 系列分立的處理器。對每一種處理器都提供完備的開發(fā)調(diào)試工具。 支持更多的FPGA器件，例如 Cyclone II,Stratix II , ProASIC3,Virtex-4,MAX II等系列器件，提供了更多類型的FPGA子板，包括多款 FPGA+MCU子板。 在器件庫方面支持基于ODBC和ADO的數(shù)據(jù)庫，可以使用OrCAD的器件庫。 Altium Designer 6.0 支持PCB界面下直接輸入漢字字符. 還有諸如 在PCB界面時,銅膜導(dǎo)線上可顯示網(wǎng)絡(luò)名(很實用哦). PCB導(dǎo)入向?qū)С艘郧暗腜rotel 99 SE DDB外,還增加了P-CAD schematic and PCB DESIGNS and libraries導(dǎo)入,OrCAD schematic and PCB DESIGNS and libraries導(dǎo)入,PADS PCB DESIGNS and libraries導(dǎo)入! Altium Designer 6.0支持后續(xù)版本的SP補丁在線更新升級. 鼠標(biāo)的操作功能可隨時自定義.如左右鍵的交換.(適合左手習(xí)慣的人吧). 還有諸如 在PCB界面時,銅膜導(dǎo)線上可顯示網(wǎng)絡(luò)名(很實用哦). Altium Limited宣布發(fā)布Altium Designer 6.0，它是完全一體化電子產(chǎn)品開發(fā)系統(tǒng)的下一個版本。Altium Designer 是業(yè)界首例將設(shè)計流程、集成化PCB 設(shè)計、可編程器件（如FPGA）設(shè)計和基于處理器設(shè)計的嵌入式軟件開發(fā)功能整合在一起的產(chǎn)品。 Altium Designer 6.0 是兩年之內(nèi)的第六次更新，極大地增強了對高密板設(shè)計的支持，可用于高速數(shù)字信號設(shè)計，提供大量新功能和改進，改善了對復(fù)雜多層板卡的管理和導(dǎo)航，可將器件放置在PCB板的正反兩面，處理高密度封裝技術(shù)，如高密度引腳數(shù)量的球型網(wǎng)格陣列 (BGAs)。 以前這些高級的 PCB 設(shè)計技術(shù)被限定在‘高級’ 的PCB 設(shè)計產(chǎn)品，這些產(chǎn)品對于大多數(shù)工程師來說價格昂貴。然而，Altium 的理念是讓電子設(shè)計變得更容易， Altium Designer 6.0 讓每一位工程師都能使用最新的設(shè)計功能。 Altium Designer 6.0 對差分信號提供系統(tǒng)范圍內(nèi)的支持，可對高速內(nèi)連的差分信號對進行充分定義、管理和交互式布線。支持包括對在FPGA項目內(nèi)部定義的LVDS信號的物理設(shè)計進行自動映射。 LVDS 是差分信號最通用的標(biāo)準(zhǔn)，廣泛應(yīng)用于可編程器件。Altium Designer 可充分利用當(dāng)今FPGA 器件上的擴展I/O管腳。 Altium Designer 6.0中的Board Insight™ 系統(tǒng)把設(shè)計師的鼠標(biāo)變成了交互式的數(shù)據(jù)挖掘工具。 Board Insight 集成了“警示”顯示功能，可毫不費力地瀏覽和編輯設(shè)計中疊放的對象。工程師可以專注于其目前的編輯任務(wù)，也可以完全進入目標(biāo)區(qū)域內(nèi)的任何其他對象，這增加了在密集、多層設(shè)計環(huán)境中的編輯速度。 Altium Designer 6.0 引入了強大的‘逃逸布線’引擎，嘗試將每個定義的焊盤通過布線剛好引到BGA邊界，這令對密集BGA類型封裝的布線變的非常簡單。 顯著的節(jié)省了設(shè)計時間，設(shè)計師無需手動就可以完成在一大堆焊盤間將線連接這些器件的內(nèi)部管腳。 Altium Designer 6.0極大減少了帶有大量管腳的器件封裝在高密度板卡上設(shè)計的時間，簡化了復(fù)雜板卡的設(shè)計導(dǎo)航功能，設(shè)計師可以有效處理高速差分信號，尤其對大規(guī)�？删幊唐骷系拇罅縇VDS資源。Altium Designer 6.0 充分利用可得到的板卡空間和現(xiàn)代封裝技術(shù)，以更有效的設(shè)計流程和更低的制造成本縮短上市時間。 |
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