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這里有設(shè)計(jì)過(guò)邏輯分析儀的嗎？ |
| 作者：qjy_dali 欄目：EDA技術(shù) |
大家交流交流 |
| 2樓： | >>參與討論 |
| 作者： 吳明詩(shī) 于 2005/8/31 11:45:00 發(fā)布：
我很想弄，因?yàn)橘I(mǎi)不起現(xiàn)成的 |
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| 3樓： | >>參與討論 |
| 作者： qjy_dali 于 2005/8/31 20:39:00 發(fā)布：
自己用CPLD和FPGA做，行不行？ |
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| 4樓： | >>參與討論 |
| 作者： 吳明詩(shī) 于 2005/8/31 20:44:00 發(fā)布：
我也想呀，大蝦有意作么 |
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| 5樓： | >>參與討論 |
| 作者： 吳明詩(shī) 于 2005/8/31 21:11:00 發(fā)布：
大蝦資料全么，可是可以的。ALTERA的片子就可以嵚入分析儀 |
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| 6樓： | >>參與討論 |
| 作者： 雷風(fēng) 于 2005/9/1 0:36:00 發(fā)布：
那個(gè)東西很爽 各位有自己做的資料么 |
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| 7樓： | >>參與討論 |
| 作者： ohoyeah 于 2005/9/1 13:12:00 發(fā)布：
我也湊個(gè)熱鬧 有技術(shù)條件嗎，我正要解密一個(gè)器件 |
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| 8樓： | >>參與討論 |
| 作者： f0rmat 于 2005/9/1 14:10:00 發(fā)布：
邏輯分析儀設(shè)計(jì)? 要是設(shè)計(jì)個(gè)低頻工作的邏輯分析工具還不算很難. 頻率稍微高一點(diǎn)就不好做了. 你想分析你的信號(hào),你的機(jī)器采樣頻率不超過(guò)10倍以上分析效果就不說(shuō)了. 另外輸出如果把數(shù)據(jù)整理在電腦上的話還要做接口,要用ram,再做幾路并行,難度不小,工程量也很大,用fpga做不如自己買(mǎi)個(gè)了. |
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| 9樓： | >>參與討論 |
| 作者： 吳明詩(shī) 于 2005/9/1 22:31:00 發(fā)布：
不知f0rmat大蝦能否給點(diǎn)資料，過(guò)兩天上網(wǎng)就不方便了。 謝謝了 |
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| 10樓： | >>參與討論 |
| 作者： 吳明詩(shī) 于 2005/9/3 0:31:00 發(fā)布：
想?yún)⒓�，可是又要考研矛盾�?br>我想資料全的話，fpga方面應(yīng)該不會(huì)太浪費(fèi)時(shí)間 |
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| 11樓： | >>參與討論 |
| 作者： 吳明詩(shī) 于 2005/9/3 0:31:00 發(fā)布：
不知夠不夠格 |
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| 12樓： | >>參與討論 |
| 作者： qjy_dali 于 2005/9/3 12:26:00 發(fā)布：
做多層PCB估計(jì)是做不起啊 而雙面板的話，肯定采樣頻率做不太高呀 |
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| 13樓： | >>參與討論 |
| 作者： qjy_dali 于 2005/9/3 23:01:00 發(fā)布：
唉，我的VHDL也忘得差不多了，編的太少了，好長(zhǎng)時(shí)間不用了 |
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| 14樓： | >>參與討論 |
| 作者： luoqiang28 于 2005/9/5 11:43:00 發(fā)布：
可以的話，我也加入 |
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| 15樓： | >>參與討論 |
| 作者： ohoyeah 于 2005/9/6 13:35:00 發(fā)布：
我倒是覺(jué)得沒(méi)必要要CPU 要CPU傳數(shù)據(jù)，采用并口、串口、儲(chǔ)存、USB、ETHERNET？ 我覺(jué)得怎么傳都慢，唯一好用的可能是并口。 是不是可以自己將所有可能邏輯都預(yù)測(cè)，然后去監(jiān)視結(jié)果，現(xiàn)存在板上，再通過(guò)串口轉(zhuǎn)移到電腦里分析。畢竟做個(gè)串口很簡(jiǎn)單。 |
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| 16樓： | >>參與討論 |
| 作者： aspist 于 2005/9/8 10:09:00 發(fā)布：
不如買(mǎi)一個(gè)，現(xiàn)在周立功的LA1024才1680元 自己做，軟件方面的工作量也不少 |
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| 17樓： | >>參與討論 |
| 作者： qjy_dali 于 2005/9/10 14:01:00 發(fā)布：
要是公司當(dāng)然買(mǎi)了 |
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